本文介绍的系统是一个以PowerPC 405为微处理器，基于VME总线的以太网接口设备，它通过以太网和VME总线接口，实现VME系统与外部局域网的实时数据交换。
上传时间： 2014-01-16
上传用户：xymbian
基于fpga的高速数据采集卡设计制作
上传时间： 2013-10-20
上传用户：suicone
计算机对信号进行分析和处理依赖于数据的采集，而现有的数据采集卡成本高，接口复杂，不易扩展。采用USB控制器和FPGA为核心设计系统的硬件平台，再结合LabVIEW设计用户应用程序、NI-VISA开发USB驱动程序，最终实现高速数据采集系统的设计。实验结果表明，系统集成度高，结构灵活便于扩展，达到了30Mbit/s的可靠数据传输速度。
上传时间： 2013-10-23
上传用户：jixingjie
基于VHDL语言开发的I486总线接口程序。实现了一个三态的总线，可保证数据的正常传输。
上传时间： 2015-07-22
上传用户：ynsnjs
针对多DSP 共享总线的通用信号处理板卡, 介绍了基于PCI9054 和CPCI 总线的接口设计, 分析了通用WDM总线驱动程序的开发。采用Verilog HDL 用CPLD 设计控制时序实现了DSP 和 CPCI 总线桥接器PCI9054 之间的普通传输和高速DMA 传输。驱动程序采用DriverWorks 和Windows 驱动开发包DDK 进行开发, 具有很好的通用性和可移植性。
上传时间： 2013-12-24
上传用户：tedo811
开发了地面实验验证系统中的实时数据采集软件:利用RTX提供的高速，准确 的RTSS响应，来优化windows中断服务线程机制、1/O端口调用机制等等，使得基于 RTX环境的数据采集卡具有更强的实时性能.
上传时间： 2016-11-14
上传用户：yiwen213
I2C总线在多机通信中的应用介绍了I2C总线的结构、工作原理、数据传输方式，讨论了基于I2C总线的多机通信软硬件设计，实现了程控交换多机通信调度指挥系统。
上传时间： 2014-12-03
上传用户：siguazgb
研究了多速率mesh网络中节点的吞吐量.:提出了多速率无线Mesh网络中节点吞吐量分析模型,用以分析在公平性保证条件下基于IEEE 802·11协 议构建的无线Mesh网络节点吞吐量.该模型计算出不同速率无线链路发送数据包的时间,寻找网络中单位时间 内完成数据包发送时间最大的瓶颈冲突域,根据瓶颈冲突域内负载流量速率得到节点吞吐量最大值.仿真结果表 明,该方法计算出的节点最大吞吐量与网络仿真结果一致,可以准确分析多速率无线Mesh网络节点吞吐量.
上传时间： 2014-07-09
上传用户：refent
随着汽车电子技术的发展，汽车作为一种融合了当代多种高新技术的交通工具，需要采用越来越多的电子控制系统，这些复杂的系统控制需要检测及交换大量数据，传统的点对点控制方式不但布线复杂、昂贵，而且可靠性差、重量大维护成本高，已经无法满足现代汽车的通信要求，为了解决上面这些问题，德国BOSCH公司的CAN总线控制应运而生，且日前得到了广泛应用。为了应对当前某些整车厂对车载CAN总线控制系统应用的需求，以及解决由于没有一个开放的CAN应用层协议，使不同配套厂的设备之间不能互操作的问题论文以基于SAEJ939协议的汽车CAN总线控制系统设计与测试作为研究课题制定了基于SAEJ939协议的CAN应用层协议并设计开发了CAN总线控制模块结合项目组已有的技术基础，论文首先研究了CAN总线协议特点和实现该技术的要求，并研究分析了CAN总线的应用层协议规范SAE939，在此基础上，根据某整车厂需求，分别从网络拓扑结构的总体设计、模块的信号定义、信息发送周期选择、报文优先级分配以及节点地址定义等几个方面设计制定了一套具有良好扩展性的汽车CAN应用层协议。此外，课题还完成了CAN总线控制模块的全部硬件设计，通过软件开发实现了所制定的CAN应用层协议以及各控制模块的功能为了验证CAN总线系统设计方案和所制定的CAN应用层协议的可行性，以及测试网络性能，课题对CAN总线控制模块和CAN网络系统进行CAN模块的致性测试，CAN控制模块通信功能测试，以及应用cAN总线开发工具 CANoe进行的CAN总线仿真实验和整个系统平台测试。通过研究这些实验和测试的结果验证了CAN总线控制系统的实时性、可靠性和稳定性，证明了课题设计方案可行此外，误题的研究也为实现具有自主知识产权的汽车CAN总线控制技术的产品化积累了经验，课题也因此具备继续研究开发的意义和良好的经济的前景
标签： 汽车CAN总线
上传时间： 2022-03-23
上传用户：fliang
本文首先对eMMC5.0规范进行了研究总结，并在此基础上根据系统指标提出了整体设计方案。存储器以FPGA作为主控制器，按照功能划分为SFP光纤接口模块、DDR3高速缓存模块、eMMC阵列存储模块和与上位机通信的干兆网模块。在系统逻辑设计中重点介绍了eMMC阵列控制逻辑的实现。通过对eMMC阵列的初始化单元、传输控制单元、命令接口单元以及阵列同步逻辑单元的设计，实现了eMMC阵列在HS400工作模式下的数据存储。然后对系统其他模块进行设计，配合完成整个系统的存储功能。最后，依据设计方案，搭建了硬件测试平台。使用ChipScope，IBERT等对各个模块进行了在线调试。重点对eMMC阵列控制器进行了调试，并对SFP光纤接口模块和DDR3高速缓存模块的逻辑进行了验证。结果表明，本文设计的使用eMMC新型存储介质的高速固态存储器能够实现156MB/s的存储带宽，同时具有容量大、可移植强与系统升级容易等特点，满足设计要求。本文开展的基于eMMC阵列的高速固态存储器的研究与设计，为后续动态测试领域的应用奠定了基础。关键词：eMMC阵列，eMMC5.0，数据存储器，HS400
上传时间： 2022-06-19
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