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  • 3000VA UPS电源电路图 -原理图

    3000VA UPS电源电路原理图

    标签: 3000 UPS VA 电源电路图

    上传时间: 2013-06-30

    上传用户:linlin

  • 正弦波逆变器原理图

    正弦波逆变器原理图,网上下载,做了一个,感觉不错,

    标签: 正弦波逆变器 原理图

    上传时间: 2013-05-24

    上传用户:s蓝莓汁

  • 屏上显示模块的FPGA实现

    随着数字电视技术的飞速发展,数字机顶盒已成为现在模拟电视收看数字电视节目必不可少的设备。而数字机顶盒需要在解码后的模拟视频信号上加入屏幕显示信息(如亮度、色度、信息服务菜单等)以提供给观众良好的界面和灵活的人机交互。 v屏幕显示系统(OSG,On-Screen-Graphics)解决了现有模拟电视无法实现的叠加屏幕显示信息的问题,提供同步输出叠加有各种图形、文字的电视节目图像的功能,其中最主要的部分是OSD(On-Screen-Display),即屏幕显示单元。OSD将叠加的位图图像分为多个OSD块,一般定义为矩形区域。每个矩形区域,例如台标、参数调节框、字幕等,都有独立的4色、16色或256色颜色查找表。同时OSG系统也支持真彩模式。OSD块经由编码/混合器与视频图像进行alpha混合后输出到电视屏幕上。 本文详细介绍了应用FPGA设计包括屏幕显示单元在内的OSG系统的思路和设计过程,描述了模块的划分与功能仿真。在论文前半部分,本文给出了图文屏幕显示系统各子单元的工作流程,接着论文的后半部分,给出了详细的模块接口说明和硬件实现。

    标签: FPGA 显示模块

    上传时间: 2013-07-27

    上传用户:万有引力

  • 基于TMS320C6713的原理图,整体方案

    ★★★★基于TMS320C6713的原理图,整体方案,包括SDRAM,FLASH,音频接口等等。-TDS6713EVM原理图

    标签: C6713 320C 6713 TMS

    上传时间: 2013-06-23

    上传用户:15510133306

  • STM32原理图及PCB库.rar

    STM32原理图及PCB库.rar原理图封装pcb

    标签: STM PCB 32

    上传时间: 2013-05-21

    上传用户:17826829386

  • 改进的图像自嵌入水印算法及其MATLAB实现

    提出通过对分块图像的DCT 系数进行动态范围压缩来改进传统的基于DCT 变换的图像自嵌入水印算法,并结合灰度变换函数与JPEG 标准量化表重新设计了DCT 系数码长分配表,大幅度提升了量化过程保留的图

    标签: MATLAB 图像 水印算法

    上传时间: 2013-07-28

    上传用户:小鹏

  • DSP28335参考原理图

    DSP28335官方参考原理图,很好用 ,分享一下。

    标签: 28335 DSP 原理图

    上传时间: 2013-07-09

    上传用户:skfreeman

  • 阻抗匹配与史密斯(Smith)圆图

    本文利用史密斯圆图作为RF阻抗匹配的设计指南。文中给出了反射系数、阻抗和导纳的作图范例,并用作图法设计了一个频率为60MHz的匹配网络。

    标签: Smith 阻抗匹配 史密斯

    上传时间: 2013-06-18

    上传用户:huangping588

  • 教你如何在orcad设计原理图怎样在powerpcb中生成PCB的步骤及方法

    教你如何在orcad设计原理图怎样在powerpcb中生成PCB的步骤及方法

    标签: powerpcb orcad PCB 设计原理

    上传时间: 2013-07-05

    上传用户:huyanju

  • 基于DSPFPGA的数字电视条件接收系统

    这篇论文以数字电视条件接收系统为研究对象,系统硬件设计以DSP和FPGA为实现平台,采用以DSP实现其加密算法、以FPGA实现其外围电路,对数字电视条件接收系统进行设计。首先根据数字电视条件接收系统的原理及其软硬分离的发展趋势,提出采用 DSP+FPGA结构的设计方式,将ECC与AES加密算法应用于SK与CW的加密;根据其原理对系统进行总体设计,同时对系统各部分的硬件原理图进行详细设计,并进行 PCB设计。其次采用从上而下的设计方式,对FPGA实现的逻辑功能划分为各个功能模块,然后再对各个模块进行设计、仿真。采用Quartus Ⅱ7.2软件对FPGA实现的逻辑功能进行设计、仿真。仿真结果表明:基于通用加扰算法(CSA)的加扰器模块,满足TS流加扰要求;块加密模块的最高时钟频率达到229.89MHz,流加密模块的最高时钟频率达到331.27MHz,对于实际的码流来说,具有比较大的时序裕量;DSP接口模块满足 ADSP BF-535的读写时序;包处理模块实现对加密后数据的包处理。最后对条件接收系统中加密算法程序采用结构化、模块化的编程方式进行设计。 ECC设计时采用C语言与汇编语言混合编程,充分利用两种编程语言的优势。将ECC 与AES加密算法在VisualDSP++3.0开发环境下进行验证,并下载至ADSP BF-535评估板上运行。输出结果表明:有限域运算汇编语言编程的实现方式,其运行速度明显提高, 192位加法提高380个时钟周期,32位乘法提高92个时钟周期;ECC与AES达到加密要求。上述工作对数字电视条件接收系统的设计具有实际的应用价值。关键词:条件接收,DSP,FPGA,ECC,AEs

    标签: DSPFPGA 数字电视 条件接收系统

    上传时间: 2013-07-03

    上传用户:www240697738