这篇论文在系统分析国内外雷达伺服控制系统研究现状的基础上，选定以ARM为内核的基于ARM+FPGA的雷达伺服控制器为研究对象。 首先，根据雷达伺服控制系统功能要求与性能指标，进行系统的硬件设计：选择基于ARM920T的S3C2410和Altera公司的FPGA芯片EP1C12Q240作为主控芯片，ARM与FPGA的连接形式采用中断+存储器的形式；将ARM与FPGA上多余的引脚引出作为将来升级的需要；还画出ARM+FPGA的雷达伺服控制器的系统图并制作了PCB板。 其次，选用PID对伺服系统进行控制，模糊神经网络综合了模糊控制和神经网络的优点，并利用模糊神经网络算法对PID参数进行在线调整。用Matlab7.1进行仿真，其结果表明：该控制算法对系统具有良好的控制效果，性能较常规PID得到较大改善。 最后，根据FPGA在伺服系统主要任务，用VHDL语言和原理图在FPGA芯片中分别编制实现DAC0832接口控制功能、光电编码器与脉冲发生电路的程序代码；并在Quartus II6.0环境下通过仿真，且得到仿真的波形符合系统功能要求。采用C语言编写在ARM中实现模糊神经网络PID控制算法的代码，通过CodeWarrior for ARM的编译无误后，生成可执行文件.axf,，调用AXD进行在线仿真调试。仿真结果表明：模糊神经网络PID算法对伺服系统能够进行有效控制。 结果表明：ARM作为伺服控制器的内核，其性价比与集成度高：用FPGA芯片实现接口电路使伺服控制器的可靠性高、速度快、可配置及连接方式灵活。因此采用基于ARM+FPGA的雷达伺服控制器，提高了系统的开放性、实时性、可靠性，降低了系统功耗，具有重要的应用价值。
上传时间： 2013-06-30
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PCI(Peripheral Component Interconnect)总线以其高性能、低成本、开放性、独立于处理器、软件透明等众多优点成为当今最流行的计算机局部总线。在嵌入式系统领域中，许多IP都是基于PCI总线设计的。本文阐述一种以ARM9作为CPU的嵌入式系统的PCI北桥设计与验证。 首先介绍基于ARM的嵌入式系统结构，并深入研究PCI2.2总线行为规范。在此基础上提出一种基于ARM处理器的PCI总线北桥的设计方案，整个设计主要分为主设备接口模块，目标设备接口模块，配置寄存器模块和集成总线仲裁器三大部分。对于主设备接口模块和目标设备接口模块，论文主要从数据通路和控制路径的实现两方面进行阐述。对于集成的总线仲裁器，设计采用两优先级的循环优先算法，通过一组设备编号寄存器实现了PCI总线上的仲裁，此外，论文对跨时钟域的信号同步和PCI配置寄存器也作了较为详细的描述，最终采用自顶向下的方法实现了整个设计。 在验证部分，引入了基于平台的验证思路，通过搭建验证平台，可以高效地实现验证。论文重点讨论了验证平台的搭建和行为模型的建立，并介绍了一种命令总线，通过打包各个验证点控制验证流程。此外，为提高验证的自动化程度，论文对验证所使用的脚本也进行了描述。通过此验证平台和脚本，提高了整个验证系统的可移植性和可重用性。 论文最终完成了PCI北桥的RTL级的功能描述，并使用仿真软件完成对设计的仿真验证。设计通过验证并成功实现在基于ARM的集成处理器，达到预定的功能设计要求，并具有良好的性能，最后对后续开发进行了探讨。
上传时间： 2013-05-22
上传用户：uuuuuuu
随着信息化、网络化和智能化的发展，嵌入式系统和加密技术成为当今热门的技术。本文将两方面的技术结合起来，在对ARM嵌入式系统和高级数据加密标准算法Rijndael作全面分析的基础上，对其应用做了研究。 文中首先分析了嵌入式系统和数据加密算法的发展状况，介绍了 ARM微处理器体系结构和 Rijndael 算法原理的相关知识。然后，结合课题研究，详细介绍了开发板 SHX-ARM7 的硬件配置和嵌入式软件开发环境的建立，包括 ADS1.2和超级终端的设置。 文中深入研究了嵌入式操作系统的移植和 Rijndael 算法在开发板上的编程实现，给出了仿真实验结果。选择移植的μC/OS-Ⅱ操作系统具有良好的实时性、可扩展性和可移植性，为进一步的嵌入式应用打下基础。Rijndael 算法的实现分为三大模块：密钥扩展、加密和解密模块，其结果可作为API函数，在嵌入式加密应用软件编程中直接调用。 本文对基于 ARM 的 Rijndael 算法的应用进行了探讨，给出了基于ARM微处理器与Rijndael算法的IC卡数据加密系统的设计方案，并提出了三种密钥安全管理方案，经比较重点描述了“一卡一密、一次一密”的密码管理思想。该方法能够保证每张 IC 卡每次用来存储重要数据时的初始密钥都是随机的，在一定程度上增加了破译难度，提高了安全性。 在结论中阐述了尚需进一步解决的问题以及下一步的工作内容。
上传时间： 2013-07-06
上传用户：kjgkadjg
Linux设备驱动程序的开发工作涉及到相当多的系统内核细节，对开发人员的要求很高。由于缺乏必要的可重用性，一个新设备的驱动程序的开发速度也很缓慢。为了简化其开发流程和提高已有代码的可重用性，该文将C+
上传时间： 2013-04-24
上传用户：vendy
目前，嵌入式系统在工业控制和智能家电等众多领域得到了广泛的应用。但同时大量的嵌入式应用也对嵌入式设备的性能和功能提出了更高的要求。随着国内嵌入式应用领域的发展，ARM芯片以其高性能、低功耗、低成本的优势获得了广泛的重视和应用。嵌入式Linux是在标准Linux基础上，经过适当地简化(裁剪)，然后加入一些特定的功能，形成的一个精巧的、高效的、满足特定应用需求地专用(定制)操作系统，它具有用户可裁剪、可配置的特点。在各种嵌入式操作系统中，嵌入式Linux凭借其内核结构优良、功能强大、高性能、稳定性好以及源代码开放等方面的优势，成为了嵌入式系统领域应用中的技术热点。本论文设计了以嵌入式微处理器和嵌入式操作系统为核心的系统，并在这个平台上实现了应用软件，构建了一个嵌入式的数据采集和发布系统，可以对设备数据进行串口采集，并利用因特网进行发布和控制操作。 为了实现这些功能，本文选用了Cirrus Logic公司的EP9302(ARM920T)作为系统的核心，以源代码开放的经过裁剪配置的嵌入式Linux为软件平台，设计了应用软件的设备数据采集、数据分析、数据交换网关模块，实现了网页服务器GoAhead移植，并完成了GoAhead服务器支持的自己的ASP页面以及后台函数的编写，并在此基础上研究了系统为保证可靠性而采取的一些措施。在整个系统的设计过程中充分发挥了嵌入式Linux的可移植性好、源代码公开、开发成本低的优点，解决了软件移植和设计编写、提高系统可靠性等的一系列关键性问题。 本嵌入式系统采集平台的用途是实时采集被监控设备的当前运行状况信息，使用户能够远程通过网页浏览器及时掌握被监控设备的运行状况，在必要时刻根据需要能够对设备进行相关控制操作和设置相关运行参数，以便能够控制被监控设备的运行方式。本论文设计的嵌入式数据采集、发布系统可以在类似远程数据控制的系统中得到广泛应用。
上传时间： 2013-05-27
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ASIC对产品成本和灵活性有一定的要求.基于MCU方式的ASIC具有较高的灵活性和较低的成本,然而抗干扰性和可靠性相对较低,运算速度也受到限制.常规ASIC的硬件具有速度优势和较高的可靠性及抗干扰能力,然而不是灵活性较差,就是成本较高.与传统硬件(CHW)相比,具有一定可配置特性的场可编程门阵列(FPGA)的出现,使建立在可再配置硬件基础上的进化硬件(EHW)成为智能硬件电路设计的一种新方法.作为进化算法和可编程器件技术相结合的产物,可重构FPGA的研究属于EHW的研究范畴,是研究EHW的一种具体的实现方法.论文认为面向分类的专用类可重构FPGA(ASR-FPGA)的研究,可使可重构电路粒度划分的针对性更强、设计更易实现.论文研究的可重构FPGA的BCH通讯纠错码进化电路是一类ASR-FPGA电路的具体方法,具有一定的实用价值.论文所做的工作主要包括:(1)BCH编译码电路的设计——求取实验用BCH码的生成多项式和校验多项式及其相应的矩阵并构造实验用BCH码;(2)建立基于可重构FPGA的基核——构造具有可重构特性的硬件功能单元,以此作为可重构BCH码电路的设计基础;(3)构造实现可重构BCH纠错码电路的方法——建立可重构纠错码硬件电路算法并进行实验验证;(4)在可重构纠错码电路基础上,构造进化硬件控制功能块的结构,完成各进化RLA控制模块的验证和实现.课题是将可重构BCH码的编译码电路的实现作为一类ASR-FPGA的研究目标,主要成果是根据可编程逻辑电路的特点,选择一种可编程树的电路模型,并将它作为可重构FPGA电路的基核T;通过对循环BCH纠错码的构造原理和电路结构的研究,将基核模型扩展为能满足纠错码电路需要的纠错码基本功能单元T;以T作为再划分的基本单元,对FPGA进行"格式化",使T规则排列在FPGA上,通过对T的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL语言描述以实现硬件电路;采用RLA模型的有限状态机FSM方式实现了可重构纠错码电路的EHW的各个控制功能块.在实验方面,利用Xilinx FPGA开发系统中的VHDL语言和电路图相结合的设计方法建立了循环纠错码基核单元的可重构模型,进行循环纠错BCH码的电路和功能仿真,在Xilinx公司的Virtex600E芯片进行了FPGA实现.课题在研究模型上选取的是比较基本的BCH纠错码电路,立足于解决基于可重构FPGA核的设计的基本问题.课题的研究成果及其总结的一套ASR-FPGA进化硬件电路的设计方法对实际的进化硬件设计具有一定的实际指导意义,提出的基于专用类基核FPGA电路结构的研究方法为新型进化硬件的器件结构的设计也可提供一种借鉴.
上传时间： 2013-07-01
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由于集成电路产业在中国的飞速发展,FPGA设计技术,作为一种灵活性很强的芯片设计技术,在国内得到广泛的应用.由于芯片的可升级性和开发自主知识产权芯片的必要性,在北京邮电大学宽带通信网络实验室开发的三层以太网交换机项目中,以太网口和ATM口之间的数据通道的实现上采用了FPGA设计方法.该文主要集中在ATM口之间的数据通道的HEC头校验的FPGA实现.并完成了硬件设计、配置、硬件测试联调工作以及论文撰写工作.硬件的设计和开发基于Protel99和Tornado/VxWorks,软件的设计和开发采用了标准的VHDL语言,开发环境是WINDOWS,开发工具是Xilinx公司的iSE4.1i集成开发环境.随着网络设备的发展,位于网络边缘的设备将会变得更加灵巧,更加迎合网络发展的需要,在网络设备上越来越多地引入了网络处理器.我们实验室和Intel建立了联合实验室,在此基础上,我们要把网络处理器评估板硬件上,运行软件,使其成为路由器,首先要加载的就是网络路由协议.由于Linux的开放源代码,所以我们决定采用Linux做嵌入式系统,在上面运行zebra的路由协议.Zebra是linux上面的开放源代码的路由软件.
上传时间： 2013-07-08
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边界扫描技术是一种应用于数字集成电路器件的标准化可测试性设计方法，它提供了对电路板上元件的功能、互连及相互间影响进行测试的一种新方案，极大地方便了系统电路的测试。本文基于IEEE 1149.1标准剖析了JTAG边界扫描测试的精髓，分析了其组成，功能与时序控制等关键技术。 应用在FPGA芯片中的边界扫描电路侧重于电路板级测试，兼顾芯片功能测试，同时提供JTAG下载方式。针对在FPGA芯片中的应用特点，设计了一种边界扫描电路，应用于自行设计的FPGA结构之中。除了基本的测试功能外，加入了对FPGA芯片进行配置、回读以及用户自定义测试等功能。 通过仿真验证，所设计的边界扫描电路可实现FPGA芯片的测试、配置和回读等功能，并符合IEEE 11491.1边界扫描标准的规定，达到设计要求。
上传时间： 2013-04-24
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汽车仪表是驾驶员与汽车进行交流的重要窗口，也是汽车高新技术的重要部分。传统汽车仪表多使用指针型显示器件为主，如步进电机、十字线圈，辅以液晶显示，显示的信息量相对较少，且结构复杂。一方面随着汽车电子化程度的不断提高，进行技术创新，研制开发新一代汽车仪表产品；另一方面，由于能源和环保问题，汽车也将从内燃机汽车发展到包括纯电动汽车(BEF)、混合电动汽车(HEV)以及燃料电池汽车(FCV)的新能源汽车时代，因此结合新能源汽车信息量多、电子化程度高的特点，开发新一代汽车智能仪表具有重要的现实和长远意义。 本文正是在这样的背景下，以同济大学汽车学院自主研发的ROVER燃料电池轿车为研究对象，进行了汽车智能仪表的一些功能研究与开发。所做的主要工作有： (1)根据要实现的功能确定所需的硬件资源，选择合适的嵌入式硬件系统。 (2)嵌入式操作系统的选择和二次开发。在选择操作系统时要考虑到系统的硬件可移植性、实时性、对内存的需求以及提供哪些开发工具等。 (3)应用软件的开发。主要是仪表界面设计，包括数字图形显示，动画显示，数据库开发等。 (4)基于无线数据传输模块下的GPRS无线通讯实验。包括客户端和服务器端系统配置，动态域名解析等。 该仪表已应用于ROVER燃料电池轿车，实践表明，在嵌入式平台上显示车载信息，同传统仪表相比具有较大的优势。可满足小型化、轻量化的要求；造型美观，可动画显示、可读性、可视性强；可实现一表多用。从软件方面来讲，引入了操作系统的概念，增强了代码的可读性、可维护性、可扩展性以及灵活性；信息显示自由度高，显示界面人性化，可定制；即使更换硬件平台，也只需对操作系统和底层驱动程序进行少量的移植工作，而无需修改与硬件无关的应用代码。
上传时间： 2013-04-24
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扩频通信具有较强的抗干扰、抗侦查和抗衰落能力,可以实现码分多址,目前广泛应用于通信抗干扰、卫星通信、导航、保密通信、测距和定位等各个方面。另外,随着集成电路技术的飞速发展,数字接收机和软件无线电也已经是现代通信研究的一个热点。 本文正是顺应这种发展趋势,在某工程项目的通信分系统中建立CDMA直接序列扩频通信系统。 本文作者承担了多点无线扩频通信系统的研究,建立了一个完整的仿真系统。提出了适合于本系统的实现算法,同时还建立了基于软件无线电平台的系统的全FPGA设计和实现,包括各个模块的测试和整个系统的联合测试。 文章的主要内容如下： 1.简述了扩频通信及软件无线电的发展及现状。 2. 对直扩系统的基本原理和系统中采用的相关关键技术进行了阐述。相关关键技术包括扩频码的研究和选取,扩频码同步的研究,包括捕获算法和跟踪算法的研究,以及自适应门限的研究。 3.详细讨论了该多点无线通信系统的设计与实现,提出了适合于本系统的算法。首先阐述了系统的总体设计方案和设计参数,接着分为物理层和链路层详细阐述了各个模块的设计与仿真,包括matlab仿真和modelsim仿真,文中给出了大量的仿真结果图。仿真结果证明算法的正确性,仿真性能也能满足系统设计的要求。 4.介绍了该多点无线通信系统的硬件平台与系统调试。首先介绍了系统的硬件平台和硬件框图,介绍了系统的相关器件及其配置,接着介绍了FPGA的开发流程、开发工具、设计原则及遇到的相关问题,最后介绍了系统的设计验证与性能分析,给出了系统的调试方案和调试结果。 本文所讨论的多点无线通信系统已经在某工程项目的通信分系统中实现。目前工作正常,性能良好,具有通用性、可移植性,有重要的理论及实用价值。
上传时间： 2013-04-24
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