虫虫首页| 资源下载| 资源专辑| 精品软件
登录| 注册

反馈信息

  • 基于ARM的无线传感网络网关的设计

    无线传感网络WSN(Wireless Sensor Network)的基本特性是:低功耗、自组织、异构互联,这些全新的形态传统的理论和模型难以描述,巨大的潜在应用使它成为理论和应用研究的热点。无线传感器网络是一种自组织网络,让物理环境的信息主动的以无线的方式发送到人类信息世界。人类根据获取的信息做出判断,利用无线传感网络反过来将我们一定的意图反馈到客观世界。这将是一种全新的人类和自然界的沟通方式。 无线传感网络不是孤立的,需要与现有的异构网络互联才有意义,而这方面的研究也比较少,本课题就是解决无线传感网络和异构网络互联的问题,设计了适用于无线传感网络的重要联网设备——网关。研究目标是设计一个无线传感网络和以太网互通互联的网关。在深入分析多种网关模型的基础上,提出了一个性能较好的网关的软硬件架构,硬件上使用基于ARM的嵌入式系统,软件上使用基于WindowsCE的嵌入式操作系统。在这个架构的指导下,设计了网关的硬件平台和网关的配套软件。在网关完成了两种网络协议相互理解,数据双向转发的任务。为了测试网关的软硬件性能,搭建了一个完整的无线传感网络,测试了网关的各项性能指标并提出了改进措施。

    标签: ARM 无线传感 网络网关

    上传时间: 2013-04-24

    上传用户:小鹏

  • 基于LMS自适应滤波器信息采集系统设计

    设计并实现具有硬件滤波空气清新器的信息采集系统,根据空气的复杂性以及随机性,结合自适应滤波器的原理,提出一种新的空气信息采集系统设计方法。该方法利用最小均方(LMS)自适应滤波器进行软件滤波,针对空气

    标签: LMS 自适应滤波器 信息采集 系统设计

    上传时间: 2013-06-14

    上传用户:sjb555

  • 单片机解读GPS信息的程序设计

    单片机解读GPS信息(KeilC环境)(文中仅介绍时间处理方法,其他方法类似)

    标签: GPS 单片机 程序设计

    上传时间: 2013-04-24

    上传用户:Alibabgu

  • 基于ARMLinux的2n伪随机信息系统研究与开发

    随着计算机软硬水平的不断提高,嵌入式领域的发展也取得了长足的进步。目前,嵌入式与Linux技术的结合正在推动着嵌入式技术的飞速发展,嵌入式系统的研究和应用产生了显著的变化。 硬件上,嵌入式平台由51系列内核的8位机系统逐步上升到以ARM内核为主流的32位系统;软件上Linux作为操作系统的发展史上一个重要的里程碑,以高安全性和稳定性、开源免费等的优势使得其在政府、国防、教育、工业等领域获得了广泛的运用。 2n伪随机多频道激电理论(简称伪随机理论),是由何继善院士率先提出并命名的,其实质是将含有3,5,7…等多个奇数主频率的复合波同时向大地发送,接收机同时接收经大地介质传导的复合波中各主频率电流响应。在地球物理勘探领域,基于伪随机理论的数据采集系统具有抗干扰能力强、测量精度高、观测速度快、装置轻便等优点而得到广泛应用。 本文在分析伪随机理论基础上,结合当前嵌入式软硬件发展的最新成果,开展对ARM Linux嵌入式数据信息系统的研究与实现。 首先,通过需求分析,对各种采集方案比较后,设计系统总体方案。通过数据信息系统驱动总体分析,选用嵌入式板载的音频芯片实现数据A/D转换,完成Linux下采集设备驱动程序设计。 其次,在ARM9内核的S3C2410嵌入式处理器硬件平台,按照嵌入式软件开发流程,搭建嵌入式Linux交叉开发平台;裁剪并移植Linux内核,构建嵌入式文件系统。 再次,利用当前流行的嵌入式图形开发库Qtopia Core,结合Sqlite数据库与Linux多线程技术,设计数据采集应用程序,建立数据信息系统的应用软件模型,此基础上对整个系统进行测试,与理论值进行对比实验。 最后,就课题的不足做出总结,并且提出系统后期的改进建议。

    标签: ARMLinux 伪随机 信息系统

    上传时间: 2013-07-11

    上传用户:CETM008

  • 基于ARM和Linux的车载信息显控终端的研究

    汽车仪表总成是汽车和驾驶员进行信息交互的窗口。传统的汽车仪表总成采用了大量机械器件、模拟电路和少量简单数字电路的方式设计。它体积大,精确和稳定性低,显示信息少,控制按钮繁复。本项目以当前主流的嵌入式技术为基础,设计了一种以大尺寸LCD触摸屏为主要显示控制界面,以CAN总线和其他接口为信息采集渠道,以高速嵌入式ARM9微控制器为处理单元的车载信息显控终端。 作者在该项目中负责车载信息显控终端的样机设计,用Prote199完成原理图和PCB图的设计,编写测试程序对主要硬件进行测试。软件上移植Linux操作系统并编写LCD驱动程序。 论文设计的车载信息显控终端以SAMSUNG公司S3C2410ARM9微控制器为核心,以Microchip公司的MCP2515芯片为CAN总线控制器,以Sharp公司LQ080V3DG01型号的8英寸LCD屏为显控接口。存储器方面外扩了NOR FLASH、NAND FLASH、SDRAM。接口方面设计了CAN、USB、RS232、以太网等标准接口,和GPIO、AD等接口。软件上本车载信息显控终端采用自行剪裁移植的Linux操作系统,并移植了相应的LCD驱动程序。 论文主要阐述了车载信息显控终端的硬件设计,详细分析了Linux在S3C2410微控制器系统上的移植,并将在软硬件调试过程中总结的经验与大家分享。 本车载信息显控终端是对汽车仪表总成数字化和虚拟化显示控制的一个有益尝试,离最后的实用化和产品化还待进一步研究。

    标签: Linux ARM 车载信息

    上传时间: 2013-05-30

    上传用户:hechao3225

  • 环境监测管理信息系统设计开发

    为污染源远程监测系统设计开发了Client/Server模式的管理信息系统软件,整套管理软件采用Delphi开发,后台支持数据库采用SQL Server 2000。可完成系统管理、排污企业信息管理、实

    标签: 环境监测 管理信息系统 设计开发

    上传时间: 2013-07-27

    上传用户:nbdedu

  • 反馈网络零极点

    探讨RCC关于反馈环路零极点问题,分析适用于传递函数为单极点及双极点的情况

    标签: 反馈网络

    上传时间: 2013-04-24

    上传用户:498732662

  • AES加、解密算法的FPGA优化设计

    2000年10月2日,美国国家标准与技术研究所宣布采用Rijndael算法作为高级加密标准,并于2002年5月26日正式生效,AES算法将在今后很长一段时间内,在信息安全中扮演重要角色。因此,对AES算法实现的研究就成为了国内外的热点,会在信息安全领域得到广泛的应用。用FPGA实现AES算法具有快速、灵活、开发周期短等优点。 本论文就是针对AES加、解密算法在同一片FPGA中的优化实现问题,在深入分析了AES算法的整体结构、基本变换以及加、解密流程的基础上,对AES算法的加、解密系统的FPGA优化设计进行了研究。主要内容为: 1.确定了实现方案以及关键技术,在比较了常用的结构后,采用了适合高速并行实现AES加、解密算法的结构——内外混合的流水线结构,并给出了总体的设计框图。由于流水线结构不适用于反馈模式,为了达到较高的运算速度,该系统使用的是电码本模式(ECB)的工作方式; 2.对各个子模块的设计分别予以详细分析,结合算法本身和FPGA的特点,采用查表法优化处理了字节代换运算,列混合运算和密钥扩展运算。同时,考虑到应用环境的不同,本设计支持数据分组为128比特,密钥长度为128比特、192比特以及256比特三种模式下的AES算法加、解密过程。完成了AES加、解密算法在同一片FPGA中实现的这个系统的优化设计; 3.利用QLJARTUSII开发工具进行代码的编写工作和综合编译工作,在 MODELSIM中进行仿真并给出仿真结果,给出了各个模块和整个设计的仿真测试结果; 4.和其他类似的设计做了横向对比,得出结论:本设计在保证了速度的基础上实现了资源和速度的均衡,在性能上具有较大的优势。

    标签: FPGA AES 解密 算法

    上传时间: 2013-05-25

    上传用户:wcl168881111111

  • 基于FPGA技术的高性能AES_CBC算法的实现研究

    AES是美国于2000年10月份确立的高级加密标准,该标准的反馈链路模式AESCBC加密算法,用于在IPSec中替代DESCBC和3DESCBC。 加密是安全数据网络的关键,要保证在公众网上传输的信息不被窃取和偷听,必须对数据进行加密。在不影响网络性能的前提下,快速实现数据加密/解密,对于开发高性能的安全路由器、安全网关等对数据处理速度要求高的通信设备具有重要的意义。 在目前可查询的基于FPGA技术实现AESCBC的设计中,最快的加/解密速度达到700Mbps/400MHZ。商用CPU奔腾4主频3.06,用汇编语言编写程序,全部资源用于加密解密,最快的加密解密速度可以达到1.4Gbps。但根据国外测试结果表明,即使开发的路由器本身就基于高性能的双64位MIPS网络处理器,软件加密解决方案仅能达到路由器所要求的最低吞吐速率600Mbps。 本文首先研究分析了目前几种实现AESCBC的方法有缺点的情况下,在深入研究影响硬件快速实现AESCBC难点基础上,设计出一种适应于报文加密解密的硬件快速实现AESCBC的方案,在设计中采用加密解密和密钥展开并行工作,实现了在线提供子密钥。在解密中采用了双队列技术,实现了报文解密和子密钥展开协调工作,提高了解密速度。 本文在quartus全面仿真设计方案的基础上,全面验证了硬件实现AESCBC方案的正确性,全面分析了本设计加密解密的性能。并且针对设计中的流水线效率低的问题,提出改善流水线性能的方案,设计出报文级并行加密解密方案,并且给出了硬件实现VPN的初步方案。实现了单一模块加密速度达到1.16Gbps,单一模块解密速度达到900Mbps,多个模块并行工作加密解密速度达到6.4Gbps。 论文最后给出了总结与展望。目前实现的AESCBC算法,只能通过仿真验证其功能的正确性,还需要下载到芯片上做进一步的验证。要用硬件实现整个IPSec,还要进一步开发基于FPGA的技术。总之,为了适应路由器发展的需求,还有很多技术需要研究。

    标签: AES_CBC FPGA 性能 实现研究

    上传时间: 2013-05-29

    上传用户:wangzhen1990

  • 基于XC2S300E芯片的高级加密标准算法的FPGA设计

    加密算法一直在信息安全领域起着无可替代的作用,它直接影响着国家的未来和发展.随着密码分析水平、芯片处理能力和计算技术的不断进步,原有的数据加密标准(DES)算法及其变形的安全强度已经难以适应新的安全需要,其实现速度、代码大小和跨平台性均难以继续满足新的应用需求.在未来的20年内,高级加密标准(AES)将替代DES成为新的数据加密标准.高级加密标准算法是采用对称密钥密码实现的分组密码,支持128比特分组长度及128比特、192比特与256比特可变密钥长度.无论在反馈模式还是在非反馈模式中使用AES算法,其软件和硬件对计算环境的适应性强,性能稳定,密钥建立时间优良,密钥灵活性强.存储需求量低,即使在空间有限的环境使用也具备良好的性能.在分析高级加密标准算法原理的基础上,描述了圈变换及密钥扩展的详细编制原理,用硬件描述语言(VHDL)描述了该算法的整体结构和算法流程.详细论述了分组密码的两种运算模式(反馈模式和非反馈模式)下算法多种体系结构的实现原理,重点论述了基本体系结构、循环展开结构、内部流水线结构、外部流水线结构、混合流水线结构及资源共享结构等.最后在XILINX公司XC2S300E芯片的基础上,采用自顶向下设计思想,论述了高级加密标准算法的FPGA设计方法,提出了具体模块划分方法并对各个模块的实现进行了详细论述.圈变换采用内部流水线结构,多个圈变换采用资源共享结构,密钥调度与加密运算并行执行.占用芯片面积及引脚资源较少,在芯片选型方面具有很好的适应性.

    标签: S300 300E FPGA 300

    上传时间: 2013-06-20

    上传用户:fairy0212