励磁调节系统是同步发电机的重要组成部分，对同步发电机乃至电力系统的安全稳定运行有着重要影响。随着电力系统规模的不断增大，系统结构和运行方式日趋复杂，对同步发电机励磁控制系统运行的可靠性、稳定性、经济性和灵活性提出了更高的要求。本文根据励磁调节器的国内外发展趋势，研究开发了以TMS320F2812芯片为控制核心的同步发电机DSP励磁调节器。 本文首先介绍了数字励磁的发展历程、特点及应用范围，然后介绍了同步发电机励磁控制系统的国内外发展状况及趋势，提出了基于数字信号处理器 TMS320F2812 控制的绝缘栅双极晶体管(IGBT)微机励磁系统的结构和设计方案。 在详细解释功率器件 IGBT 和控制器件TMS320F2812芯片基础上，提出了励磁系统的主要硬件设计及软件实现方法；完成了IGBT励磁装置主回路和 IGBT 保护及驱动单元的设计；进行调节器硬件设计，给出了硬件原理图和软件流程图；利用TMS320F2812芯片强大的数据处理能力和丰富的片内外设和高速的实时处理能力，用单片系统结构实现了交流采样、变速积分 PID控制算法、PWM功率调节和系统保护等功能。TMS320F2812芯片的引入，大大简化了励磁控制器的硬件结构，提高了励磁系统的抗干扰能力和可靠性。 最后，为验证所设计的励磁调节器的有效性和控制效果，采用 MATLAB 中 SIMULINK 仿真平台，设计了励磁控制系统各环节的仿真模型。仿真结果表明，采用 TMS320F2812的同步发电机IGBT励磁系统具有响应快速、调节灵敏、控制性能优良等特点。
上传时间： 2013-07-29
上传用户：tb_6877751
本文针对我国当今大型仓库、大型粮库的监测与控制现状，进行研究开发，采用较为实用和先进的单片微型机控制系统，运用温度传感器和湿度传感器对温度、湿度的敏感性设计了一种基于多级通讯总线的粮库温、湿度自动监测系统，主要包括通讯控制总站以及下位机的设计。操作人员可以通过向通讯控制总站发送命令，提取下位机温、湿度数据，下位机实现温、湿度检测；同时可以查看历史检测数据，进行粮情分析和粮库管理等一系列操作。 温湿度的测量和控制系统通常被认为是一项较为简单的控制技术，但是由于湿敏元件的稳定性差，寿命短等问题，实际应用系统中能正常运行的不多，除非建立有严格的管理制度，而且管理人员的综合素质要达到一定的要求。所以，本文重点分析了湿敏传感测量的机制，选型和技术措施。在研究了多种湿度传感器性能的基础上选用了合适的湿度传感器，这是本设计的一个重点。本设计还有一个重点，用CPLD设计了一个模拟开关和显示部分。 本设计研制的上位机采用PC机，通过RS-232接口与转换器相连，转换器通过RS-485总线连接下位机，实现监控室与现场的数据通信。每台下位机位于各粮仓内，需要监测256路的温、湿度信号，为了能实现共256路温湿度的数据采集工作，本设计中用CPLD设计了一个模拟开关，每次只采集一路数据送入到单片机中去；另外，本设计的显示部分也独特的选用了CPLD来实现。正常情况下上位机每4小时向下位机发布一次检测信号(同时在任何时刻也可监控某个粮仓的温湿度情况)，下位机利用PICl6F877单片机来实现粮仓中128路温度和128路湿度的测控。 该粮仓温、湿度测控系统实用性强，成本低，数据传输效率高，可靠性好。它不仪可以应用于粮库的监控管理，而且也可推广到其他监控领域，因此具有广泛的应用前景。
上传时间： 2013-05-23
上传用户：liuwei6419
智能型充电器电源和显示的设计 随着越来越多的手持式电器的出现，对高性能、小尺寸、重量轻的电池充电器的需求也越来越大。电池技术的持续进步也要求更复杂的充电算法以实现快速、安全的充电。因此需要对充电过程进行更精确的监控，以缩短充电时间、达到最大的电池容量，并防止电池损坏。AVR 已经在竞争中领先了一步，被证明是下一代充电器的完美控制芯片。Atmel AVR 微处理器是当前市场上能够以单片方式提供Flash、EEPROM 和10 位ADC的最高效的8 位RISC 微处理器。由于程序存储器为Flash，因此可以不用象MASK ROM一样，有几个软件版本就库存几种型号。Flash 可以在发货之前再进行编程，或是在PCB贴装之后再通过ISP 进行编程，从而允许在最后一分钟进行软件更新。EEPROM 可用于保存标定系数和电池特性参数，如保存充电记录以提高实际使用的电池容量。10位A/D 转换器可以提供足够的测量精度，使得充好后的容量更接近其最大容量。而其他方案为了达到此目的，可能需要外部的ADC，不但占用PCB 空间，也提高了系统成本。AVR 是目前唯一的针对像 “C”这样的高级语言而设计的8 位微处理器。C 代码似的设计很容易进行调整以适合当前和未来的电池，而本次智能型充电器显示程序的编写则就是用C语言写的。
上传时间： 2013-05-18
上传用户：zhaiye
随着计算机和微电子技术的飞速发展，基于数字信号处理的示波器、信号发生器、逻辑分析仪和频谱分析仪等测量仪器已经应用到各个领域并且发挥着重要作用，但这些仪器昂贵的价格阻碍了它们的普遍使用。 本文针对电子测量仪器技术发展和普及的情况，结合用FPGA实现数字信号处理的优势，研究一种基于FPGA的辅助性独立电予测量仪器的软件系统。这种仪器可以作为数模混合电路测试和验证的工具，用来观察模拟信号波形、数字信号时序波形、模拟信号的幅度频谱，也可以用来产生DDS信号。在硬件选择上，使用具有Altera公司CycloneⅡ器件的平台来实现单片DSP系统，这种芯片成本低廉、工作速度快、技术兼容性好；在软件设计上，采用基于FPGA的可编程数字逻辑设计方法，这种方法具有开发难度小、功能扩展简单等优点。设计中采用的关键技术包括：基于FPGA和IP Core的Verilog HDL设计、数据采集、数据存储、数据处理以及数据波形的实时显示。对这些技术的研究探讨不仅有理论研究价值，在科学实验和产品设计中同样具有重要的实用价值。系统的设计以低资源、高性能为目标，设计中采用了科学的模块划分、设计与集成的方法，在保持原四种信号处理功能不变的前提下，尽量多的节约各种FPGA资源，为实现低成本的辅助电子测量仪器提供了可能。
上传时间： 2013-06-05
上传用户：love_stanford
函数发生器又名任意波形发生器，是一种常用的信号源，广泛应用于通信、雷达、导航等现代电子技术领域。信号发生器的核心技术是频率合成技术，主要方法有：直接模拟频率合成、锁相环频率合成（PLL）、直接数字合成技术（DDS）。DDS是开环系统，无反馈环节，输出响应速度快，频率稳定度高。因此直接数字频率合成技术是目前频率合成的主要技术之一，其输出信号具有相对较大的带宽、快速的相位捷变、极高的相位分辨率和相位连续等优点。本文的主要工作是采用SOPC结合虚拟仪器技术，进行DDS智能函数发生器的研制。 本文介绍了虚拟仪器技术的基本理论，简要阐述了仪器驱动程序、VISA等相关技术。对SOPC技术进行了深入的研究：SOPC技术是基于可编程逻辑器件的可重构片上系统，它作为SOC和CPLD/FPGA相结合的一项综合技术，结合了两者的优点，集成了硬核或软核CPU、DSP、锁相环、存储器、I/O接口及可编程逻辑，可以灵活高效地解决SOC方案，而且设计周期短，设计成本低，非常适合本设计的应用。本文还对基于DDS原理的设计方案进行了分析，介绍了DDS的基本理论以及数学综合，在研究DDS原理的基础上，利用SOPC技术，在一片FPGA芯片上实现了整个函数发生器的硬件集成。 本文就函数发生器的设计制定了整体方案，对软硬件设计原理及实现方法进行了具体的介绍，包括整个系统的硬件电路，SOPC片上系统和PC端软件的设计。在设计中，LabVIEW波形编辑软件和函数发生器二者采用异步串口进行通信。利用LabVIEW的强大功能，把波形的编辑，系统的设置放到计算机上完 成，具有人机界面友好、系统升级方便、节约硬件成本等诸多优势。同时充分利用了FPGA内部大量的逻辑资源，将DDS模块和微处理器模块集成到一个单片FPGA上，改变了传统的系统设计思路。通过对系统仿真和实际测试，结果表明该智能型函数发生器不仅能产生理想的输出信号，还具有集成度高、稳定性好和扩展性强等优点。关键词：智能型函数发生器，虚拟仪器，可编程片上系统，直接数字合成技术，NiosⅡ处理器。
上传时间： 2013-07-09
上传用户：zw380105939
高精度惯性加速度计能够实现实时位移检测，在当今民用和军用系统如汽车电子、工业控制、消费电子、卫星火箭和导弹等中间具有广泛的需求。在高精度惯性加速度计中，特别需要稳定的低噪声高灵敏度接口电路。事实上，随着传感器性能的不断提高，接口电路将成为限制整个系统的主要因素。 本论文在分析差动电容式传感器工作原理的基础上，设计了针对电容式加速度计的全差分开环低噪声接口电路。前端电路检测传感器电容的变化，通过积分放大，产生正比于电容波动的电压信号。 本论文采用开关电容电路结构，使得对寄生不敏感，信号灵敏度高，容易与传感器单片集成。为了得到微重力加速度性能，设计电容式位移传感接口电路时，重点研究了噪声问题和系统建模问题。仔细分析了开环传感器中的不同噪声源，并对其中的一些进行了仿真验证。建立了接口电路寄生电容和寄生电阻模型。 为了更好的提高分辨率，降低噪声的影响如放大器失调、1/f噪声、电荷注入、时钟馈通和KT/C噪声，本论文采用了相关双采样技术（CDS）。为了限制接口电路噪声特别是热噪声，着重设计考虑了前置低噪声放大器的设计及优化。由于时钟一直导通，特别设计了低功耗弛豫振荡器，振荡频率为1．5M。为了减小传感器充电基准电压噪声，采用两级核心基准结构设计了高精度基准，电源抑制比高达90dB。 TSMC 0．18μm工艺中的3．3V电压和模型，本论文进行了spectre仿真。 关键词：MEMS；电容式加速度计；接口电路；低噪声放大器；开环检测
上传时间： 2013-05-23
上传用户：hphh
60年代初，国际上首次将B超诊断仪应用于临床诊断，40多年来B超诊断仪的发展极为迅速。随着数字信号处理及计算机技术的发展，目前国际上先进水平的超声诊断设备几乎每一个环节都包含着数字信号处理的内容，研制全数字化的超声诊断设备已成为发展趋势。 @@ 基于FPGA及嵌入式操作系统的全数字超声诊断系统具有技术含量高、便携的特点，可用数字硬件电路来实现数据量极其庞大的超声信息的实时处理。 @@ 本文从超声诊断原理入手，在对超声诊断系统中的几个关键技术进行分析的基础上，重点研究开发超声诊断系统中数字信号处理部分的两个核心算法。以FPGA芯片为载体，在Quartus Ⅱ平台中采用Verilog HDL语言进行编程并仿真验证，分别实现了数字FIR滤波器及CORDIC坐标变换两个模块的功能。另外，采用Verilog HDL语言对应用于图像显示模块的SPI接口进行了编程设计，编译下载至FPGA中，最终实现了与ARM A8的OMPG3530板之间高速串行数据的传输。 @@ 采用在单片FPGA芯片内实现数字式超声诊断部分核心算法并与高性能ARMA8处理器相配合的数字信号处理解决方案，具有高速度、高精度、高集成度、便携的特点，为全数字化便携超声诊断设备的研制打下了基础。 @@关键词：超声诊断系统；FPGA；数字FIR滤波器；CORDIC算法；SPI总线
上传时间： 2013-07-07
上传用户：hxy200501
现场可编程门阵列(FPGA)的发展已经有二十多年，从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片。现在，FPGA已广泛地应用于通信、消费类电子和车用电子类等领域，但国内市场基本上是国外品牌的天下。 在高密度FPGA中，芯片上时钟分布质量变的越来越重要，时钟延迟和时钟偏差已成为影响系统性能的重要因素。目前，为了消除FPGA芯片内的时钟延迟，减小时钟偏差，主要有利用延时锁相环(DLL)和锁相环(PLL)两种方法，而其各自又分为数字设计和模拟设计。虽然用模拟的方法实现的DLL所占用的芯片面积更小，输出时钟的精度更高，但从功耗、锁定时间、设计难易程度以及可复用性等多方面考虑，我们更愿意采用数字的方法来实现。 本论文是以Xilinx公司Virtex-E系列FPGA为研究基础，对全数字延时锁相环(DLL)电路进行分析研究和设计，在此基础上设计出具有自主知识产权的模块电路。 本文作者在一年多的时间里，从对电路整体功能分析、逻辑电路设计、晶体管级电路设计和仿真以及最后对设计好的电路仿真分析、电路的优化等做了大量的工作，通过比较DLL与PLL、数字DLL与模拟DLL，深入的分析了全数字DLL模块电路组成结构和工作原理，设计出了符合指标要求的全数字DLL模块电路，为开发自我知识产权的FPGA奠定了坚实的基础。 本文先简要介绍FPGA及其时钟管理技术的发展，然后深入分析对比了DLL和PLL两种时钟管理方法的优劣。接着详细论述了DLL模块及各部分电路的工作原理和电路的设计考虑，给出了全数字DLL整体架构设计。最后对DLL整体电路进行整体仿真分析，验证电路功能，得出应用参数。在设计中，用Verilog-XL对部分电路进行数字仿真，Spectre对进行部分电路的模拟仿真，而电路的整体仿真工具是HSIM。 本设计采用TSMC0.18μmCMOS工艺库建模，设计出的DLL工作频率范围从25MHz到400MHz，工作电压为1.8V，工作温度为-55℃～125℃，最大抖动时间为28ps，在输入100MHz时钟时的功耗为200MW，达到了国外同类产品的相应指标。最后完成了输出电路设计，可以实现时钟占空比调节，2倍频，以及1.5、2、2.5、3、4、5、8、16时钟分频等时钟频率合成功能。
上传时间： 2013-06-10
上传用户：yd19890720
随着计算机和自动化测量技术的日益发展，测量仪器和计算机的关系日益密切。计算机的很多成果很快就应用到测量和仪器领域，与计算机相结合已经成为测量仪器和自动测试系统发展的必然趋势。高度集成的现场可编程门阵列（FPGA）是超大规模集成电路和计算机辅助设计技术发展的结果，由于FPGA器件具备集成度高、体积小、可以利用基于计算机的开发平台，用编写软件的方法来实现专门硬件的功能等优点，大大推动了数字系统设计的单片化、自动化，缩短了单片数字系统的设计周期、提高了设计的灵活性和可靠性。 本文研究基于网络的高速数据采集系统的设计与实现问题。论文完成了以FPGA结构为系统硬件平台，uClinux为核心的系统的软件平台设计，进行信号的采集和远程网络监测的功能。 论文从软硬件两方面入手，阐述了基于FPGA器件进行数据采集的硬件系统设计方法，以及基于uClinux操作系统的设备驱动程序设计和应用程序设计。 硬件方面，FPGA采用Xilinx公司Spartan系列的XC3S500芯片，用verilog HDL硬件描述语言在Xilinx公司提供的ISE辅助设计软件中实现FPGA编程。将微处理器MicroBlaze、数据存储器、程序存储器、以太网控制器、数模转换控制器等数字逻辑电路通过CoreConnect技术用OPB总线集成在同一个FPGA内部，形成一个可编程的片上系统（SOPC）。采用基于FPGA的SOPC设计的突出优点是不必更换芯片就可以实现设计的改进和升级，同时也可以降低成本和提高可靠性。 软件方面，为了更好更有效地管理和拓展系统功能，移植了uClinux到MicroBlaze软处理器上，设计实现了平台上的ADC设备驱动程序和数据采集应用程序。并通过修订内核，实现了利用以太网TCP/IP协议来访问数据采集程序获得的数据。
上传时间： 2013-05-23
上传用户：晴天666
近年来，大容量数据存储设备主要是机械硬盘，机械硬盘采用机械马达和磁片作为载体，存在抗震性能低、高功耗和速度提升难度大等缺点。固态硬盘是以半导体作为存储介质及控制载体，无机械装置，具有抗震、宽温、无噪、可靠和节能等特点，是目前存储领域所存在问题的解决方案之一。本文针对这一问题，设计基于FPGA的固态硬盘控制器，实现数据的固态存储。 文章首先介绍硬盘技术的发展，分析固态硬盘的技术现状和发展趋势，阐述课题研究意义，并概述了本文研究的主要内容及所做的工作。然后从分析固态硬盘控制器的关键技术入手，研究了SATA接口协议和NANDFLASH芯片特性。整体设计采用SOPC架构，所有功能由单片FPGA完成。移植MicroBlaze嵌入式处理器软核作为主控制器，利用Verilog HDL语言描述IP核形式设计SATA控制器核和NAND FLASH控制器核。SATA控制器核作为高速串行传输接口，实现SATA1.0协议，根据协议划分四层模型，通过状态机和逻辑电路实现协议功能。NAND FLASH控制器核管理NANDFLASH芯片阵列，将NAND FLASH接口转换成通用的SRAM接口，提高访问效率。控制器完成NAND FLASH存储管理和纠错算法，实现数据的存储和读取。最后完成固态硬盘控制器的模块测试和整体测试，介绍了测试方法、测试工具和测试流程，给出测试数据和结果分析，得出了验证结论。 本文设计的固态硬盘控制器，具有结构简单和稳定性高的特点，易于升级和二次开发，是实现固态硬盘和固态存储系统的关键技术。
上传时间： 2013-05-28
上传用户：sssnaxie
