数字锁相环DPLL源程序,用cpld编写,展开后文件比较多,大家请耐心使用。谢谢,多多支持
资源简介:数字锁相环DPLL源程序,用cpld编写,展开后文件比较多,大家请耐心使用。谢谢,多多支持
上传时间: 2013-12-20
上传用户:zl5712176
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上;顶层文件是PLL.GDF
上传时间: 2014-06-09
上传用户:daguda
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛,本例用VHDL描述了一个锁相环作为参考,源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致,...
上传时间: 2013-12-31
上传用户:hphh
资源简介:数字锁相环DPLL实例程序,帮助理解PLL的结构和详细原理
上传时间: 2014-08-14
上传用户:saharawalker
资源简介:数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。
上传时间: 2013-12-18
上传用户:libenshu01
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上; 顶层文件是PLL.GDF
上传时间: 2017-07-24
上传用户:璇珠官人
资源简介:使用VHDL语言进行设计DPLL(数字锁相环)的相关文件
上传时间: 2013-12-25
上传用户:Miyuki
资源简介:全数字锁相环(aDPLL)的部分源程序代码,是其中最重要的部分。
上传时间: 2017-09-03
上传用户:liansi
资源简介:很好的全数字锁相环源程序,大家有需要的可以看看
上传时间: 2022-07-22
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资源简介:用一片CPLD实现数字锁相环,用VHDL或V语言
上传时间: 2013-05-27
上传用户:hewenzhi
资源简介:基于FPGA实现的一种新型数字锁相环
上传时间: 2013-08-07
上传用户:2467478207
资源简介:基于FPGA的全数字锁相环设计,内有设计过程和设计思想
上传时间: 2013-08-13
上传用户:fqscfqj
资源简介:基于FPGA设计数字锁相环,提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
上传时间: 2013-08-19
上传用户:Huge_Brother
资源简介:关于数字锁相环的一点东西,可以下来看看\r\n
上传时间: 2013-08-26
上传用户:7891
资源简介:用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
上传时间: 2014-01-20
上传用户:zwei41
资源简介:数字琐相环DPLL的VERLOG代码,MODELSIM下的工程,有测试文件
上传时间: 2014-01-13
上传用户:Thuan
资源简介:用verilog语言编写的全数字锁相环的源代码,基于fpga平台
上传时间: 2015-06-13
上传用户:wanqunsheng
资源简介:数字锁相环程序,适合于FM、AM开发 数字锁相环程序,适合于FM、AM开发
上传时间: 2015-06-20
上传用户:363186
资源简介:关于数字锁相环的使用,结合FM,AM的使用来说明
上传时间: 2013-12-29
上传用户:虫虫虫虫虫虫
资源简介:全数字锁相环VHDL描述并实现功能仿真,另附有图形说明
上传时间: 2014-01-13
上传用户:shawvi
资源简介:直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.
上传时间: 2015-07-18
上传用户:妄想演绎师
资源简介:一种改进的全数字锁相环设计 一种改进的全数字锁相环设计
上传时间: 2013-12-24
上传用户:stampede
资源简介:比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。
上传时间: 2013-12-24
上传用户:362279997
资源简介:技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值
上传时间: 2015-08-21
上传用户:silenthink
资源简介:用一片CPLD实现数字锁相环,用VHDL或V语言.
上传时间: 2013-12-15
上传用户:dsgkjgkjg
资源简介:用一片CPLD实现数字锁相环,用VHDL或V语言.
上传时间: 2013-12-24
上传用户:l254587896
资源简介:用一片CPLD实现数字锁相环,用VHDL或V语言.
上传时间: 2014-01-07
上传用户:金宜
资源简介:基于ti公司6713dsp的数字锁相环,运行环境为ccs3.1。希望有所帮助。
上传时间: 2015-10-04
上传用户:ma1301115706
资源简介:全数字锁相环,包括DPD,DLF,DCO.
上传时间: 2015-10-13
上传用户:yt1993410
资源简介:一篇关于数字锁相环的很好的文章,费了很大力气才搞到的
上传时间: 2013-12-30
上传用户:zhangyi99104144