FPGA内嵌200MHz低噪声锁相环时钟发生器

相 关 资 源

• FPGA内嵌200MHz低噪声锁相环时钟发生器免费下载

  资源简介：FPGA器件在通信、消费类电子等领域应用越来越广泛，随着FPGA规模的增大、功能的加强对时钟的要求也越来越高。在FPGA中嵌入时钟发生器对解决该问题是一个不错的选择。本论文首先，描述并分析了电荷泵锁相环时钟发生器的体系结构、组成单元及各单元的非理想特性...

  标签： FPGA 200 MHz 内嵌

  上传时间： 2013-04-24

  上传用户：变形金刚

• FPGA内全数字延时锁相环的设计.rar免费下载

  资源简介：现场可编程门阵列(FPGA)的发展已经有二十多年，从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片。现在，FPGA已广泛地应用于通信、消费类电子和车用电子类等领域，但国内市场基本上是国外品牌的天下。 在高密度FPGA中，芯片上时钟分布质量变的越...

  标签： FPGA 全数字 延时

  上传时间： 2013-06-10

  上传用户：yd19890720

• 此为锁相环函数发生器 包括键盘扫描程序 频率显示程序 波形显示程序等等免费下载

  资源简介：此为锁相环函数发生器 包括键盘扫描程序 频率显示程序 波形显示程序等等

  标签： 锁相环 函数发生器 显示程序 波形显示

  上传时间： 2014-01-25

  上传用户：fnhhs

• 本文在说明全数字锁相环的基础上免费下载

  资源简介：本文在说明全数字锁相环的基础上，提出了一种利用FPGA设计一阶全数字锁相环的方法，并 给出了关键部件的RTL可综合代码，并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程，最后对一些有关的问题进行了讨论。

  标签： 全数字 锁相环

  上传时间： 2014-01-10

  上传用户：asddsd

• 应用于十万门FPGA的全数字锁相环设计免费下载

  资源简介：在过去的十几年间，FPGA取得了惊人的发展：集成度已达到1000万等效门、速度可达到400～500MHz。随着FPGA的集成度不断增大，在高密度FPGA中，芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要因素。现在，解决时钟延时...

  标签： FPGA 应用于 全数字 锁相环

  上传时间： 2013-07-06

  上传用户：LouieWu

• 基于FPGA的全数字锁相环设计免费下载

  资源简介：基于FPGA的全数字锁相环设计,内有设计过程和设计思想

  标签： FPGA 全数字 锁相环

  上传时间： 2013-08-13

  上传用户：fqscfqj

• 针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电免费下载

  资源简介：针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利 用仿真波形验证该设计的合理性和有效性。整...

  标签： FPGA 297 HCT 高频感应

  上传时间： 2014-01-11

  上传用户：AbuGe

• 基于FPGA的全数字锁相环设计,内有设计过程和设计思想免费下载

  资源简介：基于FPGA的全数字锁相环设计,内有设计过程和设计思想

  标签： FPGA 全数字 锁相环 过程

  上传时间： 2017-02-11

  上传用户：evil

• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2013-08-07

  上传用户：2467478207

• 基于FPGA设计数字锁相环免费下载

  资源简介：基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

  标签： FPGA 数字锁相环

  上传时间： 2013-08-19

  上传用户：Huge_Brother

• 高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题免费下载

  资源简介：针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利\r\n用仿真波形验证该设计的合理性和有效性...

  标签： 高频感应 加热电源 模拟锁相环 频率

  上传时间： 2013-08-22

  上传用户：nairui21

• 基于FPGA的数字三相锁相环的优化设计免费下载

  资源简介：数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明...

  标签： FPGA 数字 三相 优化设计

  上传时间： 2013-11-15

  上传用户：yjj631

• 系统地分析锁相环相位噪声免费下载

  资源简介：系统地分析锁相环相位噪声

  标签： 分 相位噪声 锁相环

  上传时间： 2013-05-24

  上传用户：eeworm

• 系统地分析锁相环相位噪声免费下载

  资源简介：系统地分析锁相环相位噪声

  标签： 分 相位噪声 锁相环

  上传时间： 2013-04-15

  上传用户：eeworm

• 系统地分析锁相环相位噪声-386页-5.8M.pdf免费下载

  资源简介：专辑类-数字处理及显示技术专辑-106册-9138M 系统地分析锁相环相位噪声-386页-5.8M.pdf

  标签： 386 5.8

  上传时间： 2013-06-21

  上传用户：qw12

• 基于FPGA的数字三相锁相环的优化设计免费下载

  资源简介：数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明...

  标签： FPGA 数字 三相 优化设计

  上传时间： 2013-10-22

  上传用户：emhx1990

• 用verilog语言编写的全数字锁相环的源代码,基于FPGA平台免费下载

  资源简介：用verilog语言编写的全数字锁相环的源代码,基于FPGA平台

  标签： verilog FPGA 语言 编写

  上传时间： 2015-06-13

  上传用户：wanqunsheng

• FPGA内嵌的BRAM资源很少免费下载

  资源简介：FPGA内嵌的BRAM资源很少，此代码为DRAM代码风格，可以极大程度上减少FPGA内嵌资源的消耗。txt文档中含源代码，直接粘成vhdl即可

  标签： FPGA BRAM 内嵌 资源

  上传时间： 2015-11-29

  上传用户：asddsd

• 　介绍了一种基于大规模FPGA及高性能DSP芯片的机载雷达信号处理嵌入式系统的设计方案及设计实现。 采用标准的VME总线及基于FPGA内嵌MGT的高速串行互连技术,具有实时性强、集成度高以及软硬件可免费下载

  资源简介：　介绍了一种基于大规模FPGA及高性能DSP芯片的机载雷达信号处理嵌入式系统的设计方案及设计实现。 采用标准的VME总线及基于FPGA内嵌MGT的高速串行互连技术,具有实时性强、集成度高以及软硬件可编程易于系统 扩展及重构的特点。

  标签： FPGA DSP VME MGT

  上传时间： 2016-05-11

  上传用户：youmo81

• 关于在FPGA或CPLD锁相环PLL原理与应用,介绍用FPGA的分频技术.免费下载

  资源简介：关于在FPGA或CPLD锁相环PLL原理与应用,介绍用FPGA的分频技术.

  标签： FPGA CPLD PLL 锁相环

  上传时间： 2016-05-12

  上传用户：edisonfather

• FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术免费下载

  资源简介：FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术

  标签： FPGA 分 发射 无线呼叫系统

  上传时间： 2016-05-29

  上传用户：youmo81

• 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL免费下载

  资源简介：分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先...

  标签： altera FPGA PLL 分频器

  上传时间： 2016-06-14

  上传用户：wpwpwlxwlx

• 基于FPGA设计数字锁相环免费下载

  资源简介：基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

  标签： FPGA 数字锁相环

  上传时间： 2013-12-25

  上传用户：dyctj

• 介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。免费下载

  资源简介：介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。

  标签： FPGA 数字锁相环 分 基本结构

  上传时间： 2016-08-12

  上传用户：xiaoyunyun

• 用FPGA实现数字锁相环免费下载

  资源简介：用FPGA实现数字锁相环，开发环境为ISE

  标签： FPGA 数字锁相环

  上传时间： 2013-12-18

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• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2014-01-12

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• 小数分频技术解决了锁相环频率合成器中的频率分辨率和转换时间的矛盾, 但是却引入了严重的相位噪声, 传统的相位补偿方法由于对Aö D 等数字器件的要求很高并具有滞后性实现难度较大。$2 调制器免费下载

  资源简介：小数分频技术解决了锁相环频率合成器中的频率分辨率和转换时间的矛盾, 但是却引入了严重的相位噪声, 传统的相位补偿方法由于对A&ouml D 等数字器件的要求很高并具有滞后性实现难度较大。$2 调制器对噪声具有整形的功 能, 因而将多阶的$2 调制器用于小数分频...

  标签： ouml 小数分频 锁相环 转换

  上传时间： 2017-01-04

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• 数字鉴相器,数字锁相环频率合成系统FPGA的实现,很有借鉴价值免费下载

  资源简介：数字鉴相器,数字锁相环频率合成系统FPGA的实现,很有借鉴价值

  标签： FPGA 数字 价值 鉴相器

  上传时间： 2017-01-08

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• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2014-01-02

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• 介绍了一种采用N 先于M 环路滤波器的全数字锁相环的设计实现。这种全数字锁 相环采用了N 先于M 环路滤波器免费下载

  资源简介：介绍了一种采用N 先于M 环路滤波器的全数字锁相环的设计实现。这种全数字锁 相环采用了N 先于M 环路滤波器，可以达到滤除噪声干扰的目的。文中讲述了这种全数字锁相环的结构和工作原理，提出了各单元电路的设计和实现方法，并给出了关键部件的VHDI 代码，最...

  标签： 环路滤波器 全数字 锁相环 设计实现

  上传时间： 2017-08-18

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