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本系统使用VHDL语言进行设计

  • 资源大小:292 K
  • 上传时间: 2016-01-21
  • 上传用户:dongjunxi126
  • 资源积分:2 下载积分
  • 标      签: VHDL 语言

资 源 简 介

本系统使用VHDL语言进行设计,采用自上向下的设计方法。目标器件选用Xilinx公司的FPGA器件,并利用Xilinx ISE 7.1 进行VHDL程序的编译与综合,然后用Modelsim Xilinx Edition 6.1进行功能仿真和时序仿真。

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