uart using verilog hdl
资源简介:uart using verilog hdl
上传时间: 2017-07-21
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资源简介:硬件uart源程序verilog hdl,即相关文档
上传时间: 2015-04-25
上传用户:pompey
资源简介:FPGA/CPLD应用,uart的verilog hdl原码
上传时间: 2013-12-28
上传用户:lizhizheng88
资源简介:uart实验verilog hdl代码,用于FPGA
上传时间: 2014-01-09
上传用户:linlin
资源简介:Design FSM using verilog hdl.
上传时间: 2017-05-04
上传用户:lili123
资源简介:uart verilog hdl 实现
上传时间: 2014-01-11
上传用户:PresidentHuang
资源简介:This verilog hdl description implements a uart.
上传时间: 2013-12-17
上传用户:wff
资源简介:占用资源少的verilog hdl uart接口;采用固定波特率115200,可以修改程序中的分频来修改波特率,模式为1个启始位,8位数据位,1个停止位;带1字节缓存;当缓存空时输出空信号
上传时间: 2013-12-28
上传用户:kikye
资源简介:实现简单的uart功能,在QuartUS4.0下编译通过,采用verilog hdl编写.
上传时间: 2013-12-18
上传用户:hfmm633
资源简介:uart转I2C的verilog hdl代码,由北京邮电大学《veriloghdl设计与EDA技术基础》教师编写
上传时间: 2014-08-03
上传用户:zhuoying119
资源简介:uart串口通信程序 用verilog hdl 编写 可以有效应用于FPGA上
上传时间: 2014-01-04
上传用户:顶得柱
资源简介:this a uart source code using verilog.
上传时间: 2016-05-19
上传用户:zsjzc
资源简介:This verilog hdl description implements a uart Version 1.1 : Original Creation 2.1 : added comments
上传时间: 2016-05-27
上传用户:1109003457
资源简介:uart pci 等verilog hdl 代码
上传时间: 2014-02-24
上传用户:waitingfy
资源简介:基于verilog hdl的uart串口接收子程序。
上传时间: 2017-09-24
上传用户:561596
资源简介:基于verilog hdl的uart串口发送子程序。
上传时间: 2017-09-24
上传用户:aysyzxzm
资源简介:verilog hdl: Magnitude For a vector (a,b), the magnitude representation is the following: A common approach to implementing these arithmetic functions is to use the Coordinate Rotation Digital Computer (CORDIC) algorithm. The CORDIC ...
上传时间: 2013-12-24
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资源简介:verilog-hdl实践与应用系统设计
上传时间: 2013-08-06
上传用户:eeworm
资源简介:精通verilog hdl:IC设计核心技术实例详解
上传时间: 2013-07-24
上传用户:eeworm
资源简介:专辑类----可编程逻辑器件相关专辑 verilog-hdl实践与应用系统设计-210页-18.0M.rar
上传时间: 2013-07-23
上传用户:小宇NVO
资源简介:专辑类-可编程逻辑器件相关专辑-96册-1.77G verilog-hdl实践与应用系统设计-210页-18.0M.pdf
上传时间: 2013-04-24
上传用户:vodssv
资源简介:采用 verilog hdl 语言在Altera 公司的FPGA 芯片上实现了RISC_CPU 的关键部件状态控制器的设计,以及在与其它各种数字逻辑设计方法的比较下,显示出使用verilog
上传时间: 2013-07-06
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资源简介:verilog hdl程序设计教程,一本实用的教程,值得一看。
上传时间: 2013-05-26
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资源简介:夏宇闻教授的数字系统设计教程verilog hdl
上传时间: 2013-07-20
上传用户:FFAN
资源简介:本文利用verilog hdl 语言自顶向下的设计方法设计多功能数字钟,突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点,并通过Altera QuartusⅡ 4.1 和ModelSim
上传时间: 2013-07-21
上传用户:ve3344
资源简介::视频图像采集verilog hdl源程序,视频解码芯片部分的,可以供参考
上传时间: 2013-04-24
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资源简介:人民邮电出版社一书的配套光盘,包含书上所有原代码,特别是状态机部分,值得学习
上传时间: 2013-05-30
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资源简介:本文主要介绍了verilog hdl 语言的一些基本知识,目的是使初学者能够迅速掌握hdl 设计方法,初步了解并掌握verilog hdl语言的基本要素,能够读懂简单的设计代码并能 够进行一些简单设计的verilog hdl建模。
上传时间: 2013-05-16
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资源简介:基于FPGA的交通灯的设计 有verilog hdl 源码、仿真图与引脚配置图,已下载实现\r\n
上传时间: 2013-08-18
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资源简介:基于FPGA的多功能数字钟的设计与实现 内附有详尽的verilog hdl源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等
上传时间: 2013-08-18
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