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verilogHDL编写的并串转换模块

  • 资源大小:209 K
  • 上传时间: 2014-01-07
  • 上传用户:xiongxianwang8
  • 资源积分:2 下载积分
  • 标      签: verilogHDL 编写 转换模块

资 源 简 介

verilogHDL编写的并串转换模块,在ISE软件中仿真过,可综合,绝对是正确的

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