虫虫首页
|
资源下载
|
资源专辑
|
精品软件
登录
|
注册
首 页
资源下载
资源专辑
技术阅读
电 路 图
教程书籍
在线计算器
代码搜索
资料搜索
代码搜索
热门搜索:
fpga
51单片机
protel99se
机器人
linux
单片机
dsp
arm
Proteus
matlab
您现在的位置是:
虫虫下载站
>
资源下载
>
VHDL/FPGA/Verilog
> 用VHDL 设计的单时钟同步十进制可逆计数器的设计
用VHDL 设计的单时钟同步十进制可逆计数器的设计
资源大小:
2 K
上传时间:
2017-05-13
上传用户:
wenyishizhu
资源积分:
2 下载积分
标 签:
VHDL
时钟同步
十进制
计数器
资 源 简 介
用VHDL 设计的单时钟同步十进制可逆计数器的设计
免注册下载
普通下载
相 关 资 源
您 可 能 感 兴 趣 的
用VHDL 设计的单时钟同步十进制可逆计数器的设计
这是同步十进制计数器的源程序
用vhdl编写的十进制计数器
这是用VHDL设计的十进制计数器
VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效
带有异步复位和同步时钟的十进制加法计数器
用VHDL语言编的带有异步清零功能的十进制计数器
同步计数器和异步计数器在设计时有哪些区别?试用 六进制计数器和一个十进制计数器构成一个六十进制同步计数器。
一个十进制计数器的vhdl程序
用4位十进制计数器对用户输入时钟信号进行计数
收藏
赞(160)
踩(0)
用户登录/注册
×
确认下载
×
免注册下载
×
用户登录
×
用户注册
×