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用VHDL语言实现半加器。已经通过编译和仿真

  • 资源大小：139 K
  • 上传时间： 2013-12-30
  • 上传用户：magicchange
  • 资源积分：2 下载积分
  • 标      签： VHDL 语言 半加器 仿真

资 源 简 介

用VHDL语言实现半加器。已经通过编译和仿真

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