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基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。

  • 资源大小：3 K
  • 上传时间： 2014-08-07
  • 上传用户：albert333
  • 资源积分：2 下载积分
  • 标      签： vhdl FPGA 数字闹钟 计时

资 源 简 介

基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。

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