基于Xilinx Vertex4的可综合的二级DCM模块源代码,可生成400Mhz时钟信号
资源简介:基于Xilinx Vertex4的可综合的二级DCM模块源代码,可生成400Mhz时钟信号
上传时间: 2013-11-25
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资源简介:基于Xilinx Vertex2的可综合的2048x10位的读写可控制FIFO模块源代码,深度可控
上传时间: 2017-01-17
上传用户:我们的船长
资源简介:本文简单探讨了verilog HDL设计中的可综合性问题,适合HDL初学者阅读 用组合逻辑实现的电路和用时序逻辑实现的 电路要分配到不同的进程中。 不要使用枚举类型的属性。 Integer应加范围限制。 通常的可综合代码应该是同步...
上传时间: 2013-10-21
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上传时间: 2013-11-18
上传用户:swaylong
资源简介:可综合的vhdl设计特点.pdf
上传时间: 2015-01-21
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资源简介:一款基于BREW平台设计并开发的可下载的应用软件
上传时间: 2015-05-15
上传用户:lanjisu111
资源简介:一组开发基于Xilinx FPGA开发DSP算法的应用资料,具有实用性,可操作性。(1)
上传时间: 2013-11-27
上传用户:qoovoop
资源简介:一组开发基于Xilinx FPGA开发DSP算法的应用资料,具有实用性,可操作性。(2)
上传时间: 2015-05-28
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资源简介:一组开发基于Xilinx FPGA开发DSP算法的应用资料,具有实用性,可操作性。(3)
上传时间: 2013-12-08
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资源简介:一组开发基于Xilinx FPGA开发DSP算法的应用资料,具有实用性,可操作性。(4)
上传时间: 2015-05-28
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资源简介:一组开发基于Xilinx FPGA开发DSP算法的应用资料,具有实用性,可操作性。(5)
上传时间: 2013-12-18
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资源简介:一个可综合的串并转换接口verilog源代码
上传时间: 2014-01-07
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资源简介:可综合的FIFO存储器,全部在一个压缩包中,测试过,可以使用.
上传时间: 2014-01-17
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资源简介:一个可综合的同步FIFO的verilog源代码
上传时间: 2015-12-13
上传用户:天诚24
资源简介:一个基于MFC的可重用的库,减少你在编程中的工作量。
上传时间: 2013-12-18
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资源简介:可综合的Verilog语法(剑桥大学,影印) Synthesizable Verilogsyntax and semantics
上传时间: 2014-01-15
上传用户:bruce5996
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上传时间: 2014-12-08
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资源简介:可综合的Verilog编码,很不错,学习Verilog必看。不容错过
上传时间: 2014-01-05
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资源简介:Verilog HDL程序设计教程,以可综合的设计为重点,同时对仿真和模拟也作了深入阐述。全面介绍了verilog HdL 词法,语法。
上传时间: 2014-01-19
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资源简介:基于ucos的可移植的键盘程序。包含了四种键盘状态,按下,弹起,按下未弹起,重复。软件去抖的功能。
上传时间: 2013-12-15
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资源简介:该文档为FPGA_ASIC-基于CPLD工作模式可调的线阵CCD驱动电路的设计讲解文档,是一份很不错的参考资料,具有较高参考价值,感兴趣的可以下载看看………………
上传时间: 2022-02-26
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上传时间: 2015-03-18
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资源简介:web流数据聚类挖掘的研究和应用。流数据作为一种特殊的可挖掘的数据类型,特别是基于网络技术迅速发展的今天,其彰显出的重要地位决定了它的挖掘技术需要被认真考虑,而如何在流数据中进行有效的聚类分析,是一个吸引研究者很大注意力的问题。
上传时间: 2013-12-23
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上传用户:ljmwh2000
资源简介:java实现的可配置的工作流引擎,采用jsp+javabean实现
上传时间: 2013-12-20
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资源简介:有趣的可视的数值方法 出自网站http://www.mathworks.com/moler
上传时间: 2014-11-28
上传用户:hustfanenze
资源简介:一个Jcreator编写的可联机的坦克大战,比较好玩,很清晰
上传时间: 2013-12-12
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