好的分频器设计程序

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  上传时间： 2016-07-15

  上传用户：songyue1991

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  资源简介：基于FPGA的分频器设计,已经通过了仿真(VHDL语言编写)

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  上传时间： 2013-12-14

  上传用户：haoxiyizhong

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  标签： VHDL 分频器

  上传时间： 2014-01-25

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  标签： vhdl 分频器

  上传时间： 2017-03-31

  上传用户：脚趾头

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  上传时间： 2013-11-29

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  上传时间： 2013-08-31

  上传用户：lhc9102

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  上传时间： 2013-09-01

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  上传时间： 2013-12-16

  上传用户：ztj182002

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  上传时间： 2014-01-25

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  上传时间： 2013-12-24

  上传用户：熊少锋

• 基于vhdl的数控分频器设计的源代码及仿真免费下载

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  标签： vhdl 数控 分频器 仿真

  上传时间： 2016-02-11

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  资源简介：利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23），用HEX3~HEX2显示分钟（0~59），用HEX1~HEX0显示秒钟（0~59）。

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  上传时间： 2014-12-20

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  标签： EDA 分频器 模块 频率信号

  上传时间： 2013-12-22

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• 数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成 果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性免费下载

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  标签： VHDL 数控 分频器 修改

  上传时间： 2014-11-29

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• 基于FPGA的分频器的设计与实现免费下载

  资源简介：该文档为基于FPGA的分频器的设计与实现简介文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………

  标签： fpga

  上传时间： 2021-11-15

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  资源简介：数控分频器设计:对于一个加法计数器，装载不同的计数初始值时，会有不同频率的溢出输出信号。计数器溢出时，输出‘1’电平，同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号；否则输出‘0’电平。

  标签： 数控 分频器 加法 计数器

  上传时间： 2015-07-16

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  标签： verilog fpga 分频器

  上传时间： 2016-07-11

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  标签： FPGA 分频器

  上传时间： 2013-08-15

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  标签： 分频器

  上传时间： 2014-11-28

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  标签： 分频器 代码 分频 频率

  上传时间： 2014-06-18

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  标签： FPGA 分频器

  上传时间： 2016-03-29

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  标签： vhdl 分频器

  上传时间： 2016-06-01

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  资源简介：该源码为VHDL语言编写的分频器，在W-4b教学平台上通过验证

  标签： VHDL 源码 分频器 语言

  上传时间： 2016-09-17

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  标签： 比较 分频 代码

  上传时间： 2016-11-13

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  上传时间： 2013-11-28

  上传用户：Shaikh

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  上传时间： 2014-01-01

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  标签： VHDL 语言 分频 模块

  上传时间： 2017-07-21

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  标签： fpga

  上传时间： 2021-12-01

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