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VHDL/FPGA/Verilog
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用VHDL编写的一个出租车计费器
资源大小:
162 K
上传时间:
2016-06-18
上传用户:
dhgagfdagfdsdgf
资源积分:
2 下载积分
标 签:
VHDL
编写
出租车计费器
资 源 简 介
用VHDL编写的一个出租车计费器,起步6元计2公里,此后每半公里计0.8元,停车等待每2.5分计0.8元。通过仿真,但未下载到CPLD测试
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