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VHDL/FPGA/Verilog
> Verilog HDL编写的四位数码管动态显示程序,外围电路用CPLD来实现
Verilog HDL编写的四位数码管动态显示程序,外围电路用CPLD来实现
资源大小:
2 K
上传时间:
2016-06-12
上传用户:
saas1988
资源积分:
2 下载积分
标 签:
Verilog
CPLD
HDL
编写
资 源 简 介
Verilog HDL编写的四位数码管动态显示程序,外围电路用CPLD来实现
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