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FPGA Verilog,双向端口的研究,比较全,由ASSIGN和ALWAYS模块组成,测试可用

  • 资源大小:114 K
  • 上传时间: 2016-04-27
  • 上传用户:Mrsliu
  • 资源积分:2 下载积分
  • 标      签: Verilog ASSIGN ALWAYS FPGA

资 源 简 介

FPGA Verilog,双向端口的研究,比较全,由ASSIGN和ALWAYS模块组成,测试可用

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