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將VHDL設計轉換成Verilog設計的程式

  • 资源大小：18 K
  • 上传时间： 2016-01-18
  • 上传用户：judydance
  • 资源积分：2 下载积分
  • 标      签： Verilog VHDL 程式

资 源 简 介

將VHDL設計轉換成Verilog設計的程式

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