本代码介绍了使用VHDL开发FPGA的一般流程，最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL，在软件开发平台ISE上完成，可以在较高速时钟频率（100MHz）下正常工作。该设计的频率计能准确的测量频率在1Hz到100MHz之间的信号。使用ModelSim仿真软件对VHDL程序做了仿真，并完成了综合布局布线，最终下载到芯片Spartan-II上取得良好测试效果。
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上传时间： 2014-01-12
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上传时间： 2014-01-17
上传用户：thesk123
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上传时间： 2016-09-01
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上传时间： 2013-12-31
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上传时间： 2015-07-24
上传用户：啊飒飒大师的
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上传时间： 2015-07-24
上传用户：zhengzg
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上传时间： 2014-11-29
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上传时间： 2014-01-18
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上传时间： 2015-07-24
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上传时间： 2015-07-24
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上传时间： 2014-01-12
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上传时间： 2014-01-20
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上传用户：偷心的海盗
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上传时间： 2013-12-25
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上传用户：tb_6877751
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上传时间： 2015-09-22
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