加法器核

相 关 资 源

• 加法器核免费下载

  资源简介：加法器核，带进位位的，xilinx公司的核，能用

  标签： 加法器

  上传时间： 2015-05-31

  上传用户：gtf1207

• 32位单精度浮点加法器免费下载

  资源简介：32位单精度浮点加法器。进行用加法运算，仿真输出

  标签： 精度 浮点 加法器

  上传时间： 2013-04-24

  上传用户：x4587

• 数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述免费下载

  资源简介：数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。\r\n

  标签： VHDL 寄存器 数控振荡器 加法器

  上传时间： 2013-09-04

  上传用户：a471778

• FPU加法器的设计与实现免费下载

  资源简介：浮点运算器的核心运算部件是浮点加法器，它是实现浮点指令各种运算的基础，其设计优化对于提高浮点运算的速度和精度相当关键。文章从浮点加法器算法和电路实现的角度给出设计方法，通过VHDL语言在QuartusII中进行设计和验证，此加法器通过状态机控制运算，有...

  标签： FPU 加法器

  上传时间： 2014-01-19

  上传用户：xauthu

• 基于选择进位32位加法器的硬件电路实现免费下载

  资源简介：为了缩短加法电路运行时间，提高FPGA运行效率，利用选择进位算法和差额分组算法用硬件电路实现32位加法器，差额分组中的加法单元是利用一种改进的超前进位算法实现，选择进位算法可使不同的分组单元并行运算，利用低位的运算结果选择高位的进位为1或者进位为...

  标签： 进位 加法器 硬件 电路实现

  上传时间： 2013-12-19

  上传用户：jshailingzzh

• 8位加法器和减法器设计实习报告免费下载

  资源简介：8位加法器和减法器设计实习报告

  标签： 8位 加法器 减法器 实习报告

  上传时间： 2013-10-22

  上传用户：sjyy1001

• 超前进位加法器的设计免费下载

  资源简介：超前进位加法器的设计

  标签： 进位 加法器

  上传时间： 2013-10-19

  上传用户：shen_dafa

• 一个无符号的加法器小程序免费下载

  资源简介：一个无符号的加法器小程序

  标签： 符号 加法器 程序

  上传时间： 2014-01-12

  上传用户：cjl42111

• 一个简单的算法加法器免费下载

  资源简介：一个简单的算法加法器

  标签： 算法 加法器

  上传时间： 2015-02-24

  上传用户：myworkpost

• 加法器,加法器描述免费下载

  资源简介：加法器,加法器描述

  标签： 加法器

  上传时间： 2015-02-27

  上传用户：lifangyuan12

• VHDL实现的超前进位加法器免费下载

  资源简介：VHDL实现的超前进位加法器

  标签： VHDL 进位 加法器

  上传时间： 2015-03-04

  上传用户：leehom61

• verilog编写的32位浮点加法器免费下载

  资源简介：verilog编写的32位浮点加法器

  标签： verilog 编写 浮点 加法器

  上传时间： 2015-03-09

  上传用户：372825274

• 加法器（使用verilog编写的）,虽然简单免费下载

  资源简介：加法器（使用verilog编写的）,虽然简单，但是这也是学习verilog最基础的东西！希望大家一起学习！

  标签： verilog 加法器 编写

  上传时间： 2013-12-10

  上传用户：410805624

• 最高优先级编码器 8位相等比较器 三人表决器（三种不同的描述方式） 加法器描述 8位总线收发器：74245 （注2） 地址译码（for m68008） 多路选择器（使用select语句）免费下载

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  标签： m68008 select 74245 for

  上传时间： 2015-04-11

  上传用户：tianyi223

• 8位加法器的原代码,主要内容下载看了就知道免费下载

  资源简介：8位加法器的原代码,主要内容下载看了就知道

  标签： 8位 加法器 代码

  上传时间： 2013-12-16

  上传用户：思琦琦

• 大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟免费下载

  资源简介：大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟，数码显示，74ls138，8，4位计数器，d，rs触发器，加法器，交通灯等，此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚

  标签： max-plus vhdl 大学 加法器

  上传时间： 2013-12-23

  上传用户：qiaoyue

• 用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。免费下载

  资源简介：用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。

  标签： Verilog HDL 全加器 语言

  上传时间： 2015-05-02

  上传用户：zukfu

• 11,13,16位超前进位加法器的Verilog HDL源代码。免费下载

  资源简介：11,13,16位超前进位加法器的Verilog HDL源代码。

  标签： Verilog HDL 11 13

  上传时间： 2013-12-28

  上传用户：ouyangtongze

• 这个是带输入的加法器vhdl代码,是带有输入端和进位的.免费下载

  资源简介：这个是带输入的加法器vhdl代码,是带有输入端和进位的.

  标签： vhdl 输入 加法器 代码

  上传时间： 2013-11-30

  上传用户：gxf2016

• 这个是带先行进位的加法器的vhdl代码,比较复杂,仅仅供大家参考.免费下载

  资源简介：这个是带先行进位的加法器的vhdl代码,比较复杂,仅仅供大家参考.

  标签： vhdl 进位 加法器 代码

  上传时间： 2014-01-03

  上传用户：klin3139

• 测试向量波形产生：VHDL实例---加法器源程序免费下载

  资源简介：测试向量波形产生：VHDL实例---加法器源程序

  标签： VHDL 测试 向量 加法器

  上传时间： 2013-12-04

  上传用户：225588

• Ripple Adder: 16-bit 全加,半加及ripple adder的设计及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置进位加法器的设计方免费下载

  资源简介：Ripple Adder: 16-bit 全加,半加及ripple adder的设计及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置进位加法器的设计方案及VHDL程序 Carry Select Adder:16 Bits 进位选择加法器的设计方案及VHDL程序

  标签： Adder Ripple ripple Carry

  上传时间： 2015-05-13

  上传用户：我们的船长

• vhdl 测试向量含测试向量（Test Bench）和波形产生：VHDL实例---相应加法器的测试向量（test bench).txt免费下载

  资源简介：vhdl 测试向量含测试向量（Test Bench）和波形产生：VHDL实例---相应加法器的测试向量（test bench).txt

  标签： Bench bench vhdl Test

  上传时间： 2015-05-13

  上传用户：天涯

• 16位高速加法器免费下载

  资源简介：16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行

  标签： 加法器

  上传时间： 2013-12-24

  上传用户：aix008

• 这是用vhdl编写的四位加法器免费下载

  资源简介：这是用vhdl编写的四位加法器，请多指教

  标签： vhdl 编写 加法器

  上传时间： 2013-12-12

  上传用户：yepeng139

• 基于maxplus2的八位加法器免费下载

  资源简介：基于maxplus2的八位加法器，已经通过仿真

  标签： maxplus2 加法器

  上传时间： 2014-01-19

  上传用户：cc1

• 数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述免费下载

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  标签： VHDL 寄存器 数控振荡器 加法器

  上传时间： 2014-08-31

  上传用户：yan2267246

• 加法器 乘法器电路 除法器电路设计 键盘扫描电路设计 显示电路免费下载

  资源简介：加法器 乘法器电路 除法器电路设计 键盘扫描电路设计 显示电路

  标签： 电路设计 加法器 乘法器 电路

  上传时间： 2015-05-29

  上传用户：671145514

• verilog shi 实现的加法器（8位）适用于初学asic免费下载

  资源简介：verilog shi 实现的加法器（8位）适用于初学asic

  标签： verilog asic shi 8位

  上传时间： 2015-06-02

  上传用户：一诺88

• N位加法器源代码免费下载

  资源简介：N位加法器源代码，通用的，通过xilinx验证，希望对大家有用。

  标签： 加法器 源代码

  上传时间： 2015-06-06

  上传用户：zhangzhenyu