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D触发器的设计 主要用在时序电路中。 所用语言为Verilog HDL.

  • 资源大小：4 K
  • 上传时间： 2014-06-23
  • 上传用户：pipinooad
  • 资源积分：2 下载积分
  • 标      签： Verilog HDL D触发器 时序电路

资 源 简 介

D触发器的设计 主要用在时序电路中。 所用语言为Verilog HDL.

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