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VHDL/FPGA/Verilog
> 该文件可用vhdl语言实现时钟8倍频
该文件可用vhdl语言实现时钟8倍频
资源大小:
2 K
上传时间:
2015-04-28
上传用户:
mtzhy2
资源积分:
2 下载积分
标 签:
vhdl
语言
实现时钟
倍频
资 源 简 介
该文件可用vhdl语言实现时钟8倍频,运行环境可在maxplus2和ise的仿真软件上
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