128位的地址译码器,在cpld或者fpga上实现兼可
资源简介:128位的地址译码器,在cpld或者fpga上实现兼可
上传时间: 2017-03-24
上传用户:2525775
资源简介:四位微程序控制器的指令译码器,运用VHDL语言实现。
上传时间: 2017-07-18
上传用户:qunquan
资源简介:卷积码是广泛应用于卫星通信、无线通信等多种通信系统的信道编码方式。Viterbi算法是卷积码的最大似然译码算法,该算法译码性能好、速度快,并且硬件实现结构比较简单,是最佳的卷积码译码算法。随着可编程逻辑技术的不断发展,使用FPGA实现Viterbi译码器的设...
上传时间: 2013-06-24
上传用户:myworkpost
资源简介:·卷积编码及基于DSP的Viterbi译码器设计
上传时间: 2013-04-24
上传用户:Jason1990
资源简介:CPLD制作的BCD译码器软件,包含源代码等
上传时间: 2014-09-09
上传用户:xiaoxiang
资源简介:提供了一个硬判决的viterbi译码器(2,1,3) 有源程序及算法描述,未成定稿,只供参考 (vhdl 语言描述)
上传时间: 2015-07-16
上传用户:天诚24
资源简介:16位的移位寄存器,加上testbench,可以在modelsim里面运行~
上传时间: 2015-07-18
上传用户:璇珠官人
资源简介:这是一个md5的杂凑算法,对于一般的文本和文件均可以进行运算,产生128位的杂凑值
上传时间: 2014-11-04
上传用户:源弋弋
资源简介:程序的地址译码,单片机系统中做为外扩接口的地址译码。
上传时间: 2015-11-23
上传用户:TF2015
资源简介:使用Verilog硬件描述语言编程的38译码器,包含测试描述
上传时间: 2014-01-23
上传用户:cc1015285075
资源简介:哈夫曼的编码译码器, 还附带有压缩跟解压缩的功能。
上传时间: 2014-12-21
上传用户:www240697738
资源简介:目前绝大部分视频数字水印系统是将一个64位-128位的条码嵌入到视频中,而本软件最大特点是可将用户任意指定的一幅120x120的 黑白图片(如电子印章)隐藏在一段视频流中。这样做的优点是给用户提供了最大的直观性,同时由于偶们嵌入的是一幅图片而不是一组确定...
上传时间: 2016-03-14
上传用户:qq21508895
资源简介:F2812上有3个32位的CPU定时器,本程序主要对CPU定时器0进行操作,100MS产生1次中断,在中断中让开发板上的L1、L3、L5、L7和L2、L4、L6、L8两组发光二极管交替闪烁。
上传时间: 2013-12-10
上传用户:litianchu
资源简介:F2812上有3个32位的CPU定时器,本程序主要对CPU定时器0进行操作,100MS产生1次中断,在中断中让 2812开发板上的L1—L8发光二极管闪烁,实现跑马灯的效果。
上传时间: 2016-04-20
上传用户:lvzhr
资源简介:Reed Solomon码的编译码器MATLAB仿真程序
上传时间: 2013-12-20
上传用户:waitingfy
资源简介:基于VHDL的LS138译码器的实现 一个很简单的程序
上传时间: 2016-07-25
上传用户:anng
资源简介:程序提供了一种高效简单的38译码器的算法,非常实用
上传时间: 2016-11-14
上传用户:ainimao
资源简介:用verilog编写的bch译码器,包括测试文件,随机加载了比特流,进行了测试。
上传时间: 2013-12-15
上传用户:mpquest
资源简介:本文为用vhdl语言编写的38译码器,为doc格式,请先复制到相应软件例如maxplus中再使用。
上传时间: 2013-12-21
上传用户:思琦琦
资源简介:sTC系列单片机内部AD的应用 STC89LE52AD、54AD、58AD、516AD这几款89系列的STC单片机内部自带有8路8位的AD转换器,分布在P1口的8位上,当时钟在40MHz以下时,每17个机器周期可完成一次AD转换。
上传时间: 2017-04-16
上传用户:weixiao99
资源简介:基于quartus II软件 用verilog 语言描述的38译码器
上传时间: 2013-12-01
上传用户:wweqas
资源简介:实现用huffman编码的编码译码器,用C++和vc6.0实现
上传时间: 2017-05-18
上传用户:Late_Li
资源简介:1位全加器 可以进行1位的二进制码的加法 想进行改进 改为4位或8位的全加器代码
上传时间: 2017-06-21
上传用户:希酱大魔王
资源简介:简单的38译码器,语句较为简捷明了.供大家参考学习.
上传时间: 2017-07-21
上传用户:sdq_123
资源简介:一种基于FPGA的Viterbi译码器一种基于FPGA的Viterbi译码器
上传时间: 2013-11-25
上传用户:xg262122
资源简介:改程序的设计的是带有并行置位的移位寄存器
上传时间: 2013-12-27
上传用户:冇尾飞铊
资源简介:基于VDHL的38译码器的实现与58分频器的实现 FPGA主芯片:CycloneII EP2C35F672C6
上传时间: 2014-01-17
上传用户:banyou
资源简介:这是个128位的串行伪随机码发生器,还可以进一步扩充
上传时间: 2017-09-16
上传用户:cmc_68289287
资源简介: 本课题首先研究了常规的RS译码器的算法,确定在关键方程的计算中采用一种新改进的BM算法,然后提出了基于复数基的有限域快速并行乘法器和利用幂指数相减进行除法计算的有限域除法器,通过这些优化方法提高了RS译码器的速度,减少了译码延时和硬件资源使用...
上传时间: 2013-06-29
上传用户:gokk
资源简介:Turbo码是一类并行级联的系统卷积码,它是在综合级联码、最大后验概率(MAP)译码、软输入软输出及迭代译码等理论基础上的一种创新。Turbo码的基本原理是通过对编码器结构的巧妙设计,多个子码通过交织器隔离进行并行级联编码输出,增大了码距。译码器则以类似...
上传时间: 2013-04-24
上传用户:shanml