aes算法的verilog hdl实现,供给大家作为参考 。
资源简介:aes算法的verilog hdl实现,供给大家作为参考 。
上传时间: 2013-12-18
上传用户:gundan
资源简介:aes高级加密算法的verilog语言实现。同时附有aes协议的pdf文档,和此代码的测试程序,可作为一个IP核直接使用,可减少开发人员的设计时间。
上传时间: 2014-01-08
上传用户:PresidentHuang
资源简介:cordic算法的verilog hdl具体实现
上传时间: 2013-12-06
上传用户:2467478207
资源简介:一个关于DES算法的verilog语言实现,包括了各个实现模块以及测试模块
上传时间: 2014-01-23
上传用户:璇珠官人
资源简介:aes算法的C语言实现方案,可以借鉴学习
上传时间: 2014-01-12
上传用户:xsnjzljj
资源简介:aes算法的verilog代码,即aes算法IP核
上传时间: 2017-09-02
上传用户:zhangzhenyu
资源简介:从算法设计到硬线逻辑的实现:复杂数字逻辑系统的verilog hdl设计技术和方法,结合DSP算法介绍verilog hdl 设计。
上传时间: 2016-12-16
上传用户:xiaohuanhuan
资源简介:基于FPGA的多功能数字钟的设计与实现 内附有详尽的verilog hdl源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等
上传时间: 2013-08-18
上传用户:问题问题
资源简介:用verilog hdl实现曼彻斯特编码的源码
上传时间: 2013-12-29
上传用户:lhc9102
资源简介:MD5算法的verilog实现,同时包含有testbench。
上传时间: 2014-01-09
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资源简介:des加密算法的verilog语言的实现
上传时间: 2015-04-10
上传用户:leixinzhuo
资源简介:aes算法的c++实现及其加密解密过程所需时间的测试,无解压密码
上传时间: 2014-01-12
上传用户:xiaohuanhuan
资源简介:verilog hdl实现的I2C Slave模拟
上传时间: 2014-11-17
上传用户:ztj182002
资源简介:硬件描述语言,verilog hdl,实现了解码器的设计
上传时间: 2013-12-22
上传用户:sclyutian
资源简介:原创verilog hdl 实现CACHE的操作,有需要请下载
上传时间: 2015-09-20
上传用户:181992417
资源简介:aes加密算法的VS2005工程实现,方便易用,在VS2005环境直接生成解决方案就能生成可执行程序,很好。
上传时间: 2013-12-25
上传用户:1966640071
资源简介:本代码是C语言实现的aes算法的源代码。aes是继DES之后目前最为流行的对称加密算法。
上传时间: 2016-02-14
上传用户:开怀常笑
资源简介:aes加密算法的Vhdl代码实现,在FPGA芯片上调试过
上传时间: 2014-08-23
上传用户:guanliya
资源简介:这是关于2分频的vhdl实现和verilog hdl实现,都已经仿真验证了其正确性,大家可以对比参考。
上传时间: 2014-10-27
上传用户:lwwhust
资源简介:用verilog hdl实现的曼彻斯特编码器和解码器。
上传时间: 2013-12-23
上传用户:lifangyuan12
资源简介:用verilog hdl实现的1553B航空电子总线接口。
上传时间: 2016-05-19
上传用户:许小华
资源简介:aes算法c++实现源码 可以用于对文档进行基于aes算法的加密和解密功能
上传时间: 2016-06-18
上传用户:ywqaxiwang
资源简介:用verilog hdl实现的VGA显示彩条信号,其中包括VGA时序、竖彩条、横彩条、棋盘格
上传时间: 2016-06-29
上传用户:yangbo69
资源简介:密码学中的aes算法的C++有一实现 密码学中的aes算法的C++有一实现
上传时间: 2016-07-05
上传用户:凌云御清风
资源简介:密码学中的aes算法的C语言又一实现 密码学中的aes算法的C语言又一实现
上传时间: 2014-11-23
上传用户:watch100
资源简介:用VHADL和verilog hdl实现带进位的8位加减法器。
上传时间: 2016-07-12
上传用户:bruce
资源简介:包含了四位计数器等基本数字模块的的verilog hdl程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成Vhdl语言进行综合
上传时间: 2013-12-19
上传用户:hopy
资源简介:基于FPGA的多功能数字钟的设计与实现 内附有详尽的verilog hdl源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等
上传时间: 2016-09-06
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资源简介:用verilog hdl实现的任意 频率分频器源代码,是一个通用的程序
上传时间: 2014-01-07
上传用户:alan-ee
资源简介:实现十字路口简单交通灯的verilog hdl源代码,可以实现
上传时间: 2013-12-17
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