用数字锁相环电路实现高精度宽范围频率控制.pdf

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• 用数字锁相环电路实现高精度宽范围频率控制.pdf免费下载

  资源简介：锁相技术相关专辑 38册 209M用数字锁相环电路实现高精度宽范围频率控制.pdf

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  上传时间： 2014-05-05

  上传用户：时代将军

• 介绍了一宽带的数字锁相环的实现方法免费下载

  资源简介：介绍了一宽带的数字锁相环的实现方法，欢迎大家踊跃下载

  标签： 宽带 实现方法 数字锁相环

  上传时间： 2015-11-25

  上传用户：咔乐坞

• 介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。免费下载

  资源简介：介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。

  标签： FPGA 数字锁相环 分 基本结构

  上传时间： 2016-08-12

  上传用户：xiaoyunyun

• 全数字锁相环电路的研制免费下载

  资源简介：全数字锁相环电路的研制，使用的是VHDL语言

  标签： 全数字 锁相环电路

  上传时间： 2017-02-02

  上传用户：坏天使kk

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛，本例用VHDL描述了一个锁相环作为参考，源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致,...

  标签： PLL 数字锁相环 接收 数字

  上传时间： 2013-12-31

  上传用户：hphh

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF

  标签： 数据 Q5 PLL 输入

  上传时间： 2014-06-09

  上传用户：daguda

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上； 顶层文件是PLL.GDF

  标签： Q5 数据 PLL 输入

  上传时间： 2017-07-24

  上传用户：璇珠官人

• 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比免费下载

  资源简介：数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比，DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。

  标签： DPLL PLL 数字锁相环 数字通信

  上传时间： 2013-12-18

  上传用户：libenshu01

• 用一片CPLD实现数字锁相环,用VHDL或V语言.rar免费下载

  资源简介：用一片CPLD实现数字锁相环,用VHDL或V语言

  标签： CPLD VHDL 数字锁相环

  上传时间： 2013-05-27

  上传用户：hewenzhi

• 用一片CPLD实现数字锁相环,用VHDL或V语言.免费下载

  资源简介：用一片CPLD实现数字锁相环,用VHDL或V语言.

  标签： CPLD VHDL 数字锁相环 语言

  上传时间： 2013-12-15

  上传用户：dsgkjgkjg

• 用一片CPLD实现数字锁相环,用VHDL或V语言.免费下载

  资源简介：用一片CPLD实现数字锁相环,用VHDL或V语言.

  标签： CPLD VHDL 数字锁相环 语言

  上传时间： 2013-12-24

  上传用户：l254587896

• 用一片CPLD实现数字锁相环,用VHDL或V语言.免费下载

  资源简介：用一片CPLD实现数字锁相环,用VHDL或V语言.

  标签： CPLD VHDL 数字锁相环 语言

  上传时间： 2014-01-07

  上传用户：金宜

• 智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信免费下载

  资源简介：智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信

  标签： VHDL CPLD 全数字 串行通信

  上传时间： 2014-01-08

  上传用户：weiwolkt

• 用FPGA实现数字锁相环免费下载

  资源简介：用FPGA实现数字锁相环，开发环境为ISE

  标签： FPGA 数字锁相环

  上传时间： 2013-12-18

  上传用户：tb_6877751

• 介绍了一种采用N 先于M 环路滤波器的全数字锁相环的设计实现。这种全数字锁 相环采用了N 先于M 环路滤波器免费下载

  资源简介：介绍了一种采用N 先于M 环路滤波器的全数字锁相环的设计实现。这种全数字锁 相环采用了N 先于M 环路滤波器，可以达到滤除噪声干扰的目的。文中讲述了这种全数字锁相环的结构和工作原理，提出了各单元电路的设计和实现方法，并给出了关键部件的VHDI 代码，最...

  标签： 环路滤波器 全数字 锁相环 设计实现

  上传时间： 2017-08-18

  上传用户：love_stanford

• 数字锁相环实现源码免费下载

  资源简介：数字锁相环实现源码，有很大的参考价值。 由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.

  标签： 数字锁相环 源码

  上传时间： 2014-01-04

  上传用户：zq70996813

• 针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电免费下载

  资源简介：针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利 用仿真波形验证该设计的合理性和有效性。整...

  标签： FPGA 297 HCT 高频感应

  上传时间： 2014-01-11

  上传用户：AbuGe

• 基于FPGA的数字锁相环的研究与实现免费下载

  资源简介：该文档为基于FPGA的数字锁相环的研究与实现总结文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………

  标签： fpga

  上传时间： 2022-04-27

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• 基于DSP Builder的带宽自适应全数字锁相环的设计与实现免费下载

  资源简介：该文档为基于DSP Builder的带宽自适应全数字锁相环的设计与实现总结文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………

  标签： dsp

  上传时间： 2022-05-01

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• 基于FPGA实现的一种新型数字锁相环免费下载

  资源简介：基于FPGA实现的一种新型数字锁相环

  标签： FPGA 新型数字 锁相环

  上传时间： 2013-08-07

  上传用户：2467478207

• 用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench免费下载

  资源简介：用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench

  标签： vhd testbench pllTB VHDL

  上传时间： 2014-01-20

  上传用户：zwei41

• 用verilog语言编写的全数字锁相环的源代码,基于fpga平台免费下载

  资源简介：用verilog语言编写的全数字锁相环的源代码,基于fpga平台

  标签： verilog fpga 语言 编写

  上传时间： 2015-06-13

  上传用户：wanqunsheng

• 全数字锁相环ＶＨＤＬ描述并实现功能仿真免费下载

  资源简介：全数字锁相环ＶＨＤＬ描述并实现功能仿真，另附有图形说明

  标签： 全数字 锁相环 功能仿真

  上传时间： 2014-01-13

  上传用户：shawvi

• 直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.免费下载

  资源简介：直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.

  标签： SYSTEMVIEW ELANIX 数字锁相环 频率合成器

  上传时间： 2015-07-18

  上传用户：妄想演绎师

• 技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值免费下载

  资源简介：技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值

  标签： 采样 比例 控制 全数字

  上传时间： 2015-08-21

  上传用户：silenthink

• 介绍了如何使用数字锁相环,如何用VHDL实现数字锁相环免费下载

  资源简介：介绍了如何使用数字锁相环,如何用VHDL实现数字锁相环

  标签： VHDL 数字锁相环 如何使用

  上传时间： 2013-12-29

  上传用户：huql11633

• 数字锁相环的源代码。用硬件编程语言VHDL编写。免费下载

  资源简介：数字锁相环的源代码。用硬件编程语言VHDL编写。

  标签： VHDL 数字锁相环 源代码 硬件编程

  上传时间： 2014-01-02

  上传用户：jackgao

• 一个实现简单的数字锁相环Verilog代码免费下载

  资源简介：一个实现简单的数字锁相环Verilog代码，本人借鉴网上现有的代码后经修改在Cyclone II上调通实现，里面有ModelSim仿真成功的波形图

  标签： Verilog 数字锁相环 代码

  上传时间： 2014-01-22

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• ＦＰＧＡ实现全数字锁相环免费下载

  资源简介：ＦＰＧＡ实现全数字锁相环，利用硬件描述评议verilog HDL，顶层文件ＤＰＬＬ．Ｖ

  标签： 全数字 锁相环

  上传时间： 2014-01-09

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• 该程序实现的功能是数字锁相环的设计。源代码可以直接进行仿真试验◎免费下载

  资源简介：该程序实现的功能是数字锁相环的设计。源代码可以直接进行仿真试验◎

  标签： 程序 数字锁相环 仿真试验 源代码

  上传时间： 2016-08-12

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