自己编写的8x8乘法器,不同的计算部分分别设计。
资源简介:自己编写的8x8乘法器,不同的计算部分分别设计。
上传时间: 2015-04-13
上传用户:wyqhjj
资源简介:一个用VerilogHDL语言编写的8X8的乘法器
上传时间: 2015-07-22
上传用户:teddysha
资源简介:用spice描述的8x8改进Booth码加wallance压缩的乘法器,并且进行了优化,时间性能相当高
上传时间: 2013-12-21
上传用户:lmeeworm
资源简介:在精密乘法器设计中采用AD630整流放大器:
上传时间: 2013-07-10
上传用户:zhyiroy
资源简介:GF_2_m_域乘法器的快速设计及FPGA实现,对于rs编翼码的理解和设计有帮助
上传时间: 2013-08-16
上传用户:tangsiyun
资源简介:简单介绍了ADI公司推出的新一代高性能模拟乘法器ADL5391的主要特性和工作原理。给出了基于ADL5391的宽带乘法器的典型应用电路,并对其进行了测试。最后设计了基于ADL5391的二倍频电路,测试结果表明该二倍频电路具有性能稳定、工作频带宽、测量精度高、抗干扰...
上传时间: 2013-10-25
上传用户:FreeSky
资源简介: 定点乘法器设计(中文) 运算符: + 对其两边的数据作加法操作; A + B - 从左边的数据中减去右边的数据; A - B - 对跟在其后的数据作取补操作,即用0减去跟在其后的数据; - B * 对其两边的数据作乘法操作; A * B & 对...
上传时间: 2013-12-17
上传用户:trepb001
资源简介: 模拟乘法器在运算电路中的应用 8.6.1 乘法运算电路 8.6.2 除法运算电路 8.6.3 开方运算电路
上传时间: 2013-10-10
上传用户:270189020
资源简介:EDA课程设计8位十进制乘法器。
上传时间: 2013-10-17
上传用户:牛津鞋
资源简介:设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发...
上传时间: 2013-10-09
上传用户:xjy441694216
资源简介:EDA课程设计8位十进制乘法器。
上传时间: 2013-10-09
上传用户:ZOULIN58
资源简介:设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发...
上传时间: 2013-10-13
上传用户:yl1140vista
资源简介:一个并行高速乘法器芯片的设计与实现
上传时间: 2014-01-08
上传用户:虫虫虫虫虫虫
资源简介:用C语言实现的乘法器
上传时间: 2013-12-08
上传用户:moerwang
资源简介:VHDL语言实现的16位快速乘法器
上传时间: 2013-11-30
上传用户:yd19890720
资源简介:四位乘法器的VHDL源程序
上传时间: 2013-12-04
上传用户:kristycreasy
资源简介:VHDL编写的硬件乘法器
上传时间: 2014-12-22
上传用户:tuilp1a
资源简介:乘法器是硬件设计中的很常见也很重要的一个模块,它的VHDL硬件实现很好的解决了软件编程中做乘法速度慢的问题,在实时高速系统应用中或DSP软核或数字信号处理硬件实现算法中,经常能使用到乘法器,所以经典的高速乘法器IP 很有参考价值
上传时间: 2015-03-18
上传用户:yimoney
资源简介:嵌入式系统的乘法器试验报告 包括源代码 用VHDL语言编写
上传时间: 2013-12-26
上传用户:wang5829
资源简介:自已写的一个16X16的乘法器,速度比较慢。初学者练习练习!
上传时间: 2015-03-31
上传用户:love1314
资源简介:8位相 加乘法器,具有高速,占用资源较少的优点
上传时间: 2014-08-06
上传用户:zhangjinzj
资源简介:MSP430F449的硬件乘法器操作IAR Practice code
上传时间: 2013-12-17
上传用户:1109003457
资源简介:这个是用VHDL编写的乘法器,仅仅供大家参考
上传时间: 2015-05-06
上传用户:我们的船长
资源简介:一种可以完成16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了改进的Booth算法,简化了部分积的符号扩展,采用Wallace树和超前进位加法器来进一步提高电路的运算速度。本乘法器可以作为嵌入式CPU内核的乘法单元,整个设计用VHDL语言实现。
上传时间: 2013-12-23
上传用户:skfreeman
资源简介:veilog实现的状态机乘法器.可以参考
上传时间: 2013-12-31
上传用户:yulg
资源简介:该源码实现了一个8*8位的乘法器,在实现的过程中用到了宏单元
上传时间: 2013-12-28
上传用户:bakdesec
资源简介:布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.
上传时间: 2015-05-20
上传用户:zycidjl
资源简介:加法器 乘法器电路 除法器电路设计 键盘扫描电路设计 显示电路
上传时间: 2015-05-29
上传用户:671145514
资源简介:本系统基于直接数字频率合成技术;以凌阳SPCE061A单片机为控制核心;采用宽带运放AD811和AGC技术使得50Ω负载上峰值达到6V±1V;由模拟乘法器AD835产生调幅信号;由数控电位器程控调制度;通过单片机改变频率字实现调频信号,最大频偏可控;通过模拟开关产生A...
上传时间: 2015-06-03
上传用户:清风冷雨
资源简介:用VHDL语言设计CPU中的一部分:乘法器的设计,包括多种乘法器的设计方法!内容为英文
上传时间: 2015-06-11
上传用户:450976175