针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的面积大了一倍,验证了动态内存核[7 ]的实用性。
上传时间: 2013-08-21
上传用户:sjw920325
ref-SDR-SDRAM-vhdl代码 SDR SDRAM Controller v1.1 readme.txt This readme file for the SDR SDRAM Controller includes information that was not incorporated into the SDR SDRAM Controller White Paper v1.1. The PLL is targeted at APEX(TM) devices. Please regenerate for your chosen architecture. Last updated September, 2002 Copyright ?2002 Altera Corporation. All rights reserved.
上传时间: 2013-11-13
上传用户:takako_yang
ref-SDR-SDRAM-vhdl代码 SDR SDRAM Controller v1.1 readme.txt This readme file for the SDR SDRAM Controller includes information that was not incorporated into the SDR SDRAM Controller White Paper v1.1. The PLL is targeted at APEX(TM) devices. Please regenerate for your chosen architecture. Last updated September, 2002 Copyright ?2002 Altera Corporation. All rights reserved.
上传时间: 2013-10-23
上传用户:半熟1994
标准SDR SDRAM控制器参考设计,Lattice提供的verilog源代码
上传时间: 2015-04-14
上传用户:frank1234
Sdr SDRAM控制器参考设计,很好的
上传时间: 2015-10-27
上传用户:manlian
Hynix公司8M byte sdr sdram的verilog语言仿真实现。
上传时间: 2014-12-04
上传用户:h886166
详细介绍了ALTERA器件的IP CORE以及如何使用SDR SDRAM CONTROL
上传时间: 2016-04-12
上传用户:685
针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的面积大了一倍,验证了动态内存核[7 ]的实用性。
上传时间: 2013-12-18
上传用户:c12228
标准SDR SDRAM控制器参考设计_verilog_lattice\sdr_ctrl.v
标签: verilog_latticesdr_ctrl SDRAM SDR 标准
上传时间: 2016-08-28
上传用户:hullow
标准SDR SDRAM控制器参考设计,有助于大家学习和参考
上传时间: 2014-01-14
上传用户:小宝爱考拉