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计PLD/FPGA时通常采用几种时钟类型

  • 资源大小:393 K
  • 上传时间: 2013-09-04
  • 上传用户:zglak
  • 资源积分:2 下载积分
  • 标      签: FPGA PLD 时钟

资 源 简 介

无沦是用离散逻辑、可编程逻辑,还是用全定制硅器件实现的任何数字设计,为了成功地操\r\n作,可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将\r\n导致错误的行为,并且调试困难、花销很大。 在设计PLD/FPGA时通常采用几种时钟类型。时钟可\r\n分为如下四种类型:全局时钟、门控时钟、多级逻辑时钟和波动式时钟。多时钟系统能够包括上\r\n述四种时钟类型的任意组合。

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