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一种64位浮点乘加器的设计与实现

  • 资源大小:320 K
  • 上传时间: 2024-11-03
  • 上传用户:qdxqdxqdxqdx
  • 资源积分:2 下载积分
  • 标      签: 64位 浮点 乘加器

资 源 简 介

·摘要:  乘加操作是许多科学与工程应用中的基本操作,特别是在图形加速器和DSP等应用领域,浮点乘加器有着广泛的应用.论文针对PowerPC603e微处理器系统,基于SMIC 0.25μm 1P5M CMOS工艺,采用正向全定制的电路及版图设计方法,设计实现了一个综合使用改进Booth算法、平衡的4-2压缩器构成的Wallace树形结构、先行进位加法器的支持IEEE-754标准的64bit

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