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DSP内嵌PLL中的CMOS压控环形振荡器设计

  • 资源大小:304 K
  • 上传时间: 2024-08-30
  • 上传用户:lijumiao
  • 资源积分:2 下载积分
  • 标      签: CMOS

资 源 简 介

·摘要:  介绍了一种用于DSP内嵌锁相环的低功耗、高线性CMOS压控环形振荡器.电路采用四级延迟单元来获得相位相差90.的正交输出时钟,每级采用调节电流源大小,改变电容放电速度的方式.基于SMIC 0.35μm CMOS工艺模型的仿真结果表明,电路可实现2MHz至90MHz的频率调节范围,在中心频率附近具有很高的调节线性度,且总功耗仅为3.5mW.  

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