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基于vhdl的移位寄存器设计

  • 资源大小:1 K
  • 上传时间: 2024-05-18
  • 上传用户:zhengtiantong
  • 资源积分:2 下载积分
  • 标      签: vhdl

资 源 简 介

16位带有并行预置功能的右移移位寄存器,CLK1是时钟信号, LOAD是并行数据使能信号,QB是串行输出端口

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