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基于Verilog HDL设计的多功能数字钟

  • 资源大小:123 K
  • 上传时间: 2024-05-01
  • 上传用户:yui0900826
  • 资源积分:2 下载积分
  • 标      签: Verilog

资 源 简 介

本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟,突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点,并通过Altera QuartusⅡ 4.1 和ModelSim

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