This circuit is a synchronous, reversible, up/down counter.
The 191 is a 4-bit binary counter. Sy
资源简介:用VHDL 设计的单时钟同步十进制可逆计数器的设计
上传时间: 2017-05-13
上传用户:gundamwzc
资源简介:M进制可逆计数器的设计、仿真及实验
上传时间: 2013-10-17
上传用户:oojj
资源简介:大学计算机数字逻辑实验作业 用Multisim仿真软件编写 计数器 用双D触发器74Ls74构成四位二进制串行计数器 二分频计数原理
上传时间: 2014-01-21
上传用户:wyc199288
资源简介:该代码是100进制可逆计数器的源代码,已经在软件上调试过了,比较有用的
上传时间: 2015-08-23
上传用户:冇尾飞铊
资源简介:设计功能及要求 设计M=99的十进制加/减可逆计数器 (1)接通电源时电路能自启动; (2)手动分别实现加、减计数和自动实现加减可逆计数; (3)用数码管显示计数数值。 (4)给定元件:74LS192、74LS00、74LS76、74LS48及LED。
上传时间: 2014-01-23
上传用户:asdfasdfd
资源简介:用2051制的绕线机[5位数+可预置数+减速+可逆计数器
上传时间: 2016-09-26
上传用户:003030
资源简介:这是同步十进制计数器的源程序,有需要的同学可以参照一下!
上传时间: 2013-12-28
上传用户:源码3
资源简介:4位可逆计数器:将50MHz的时钟进行 分频后的结果作为时钟控制,根据输入进行条件判断,再通过设置一个四位的向量将结果输出,利用数码管显示在实验板上
上传时间: 2017-06-18
上传用户:lanjisu111
资源简介:可逆逻辑电路能大幅度降低能耗,越来越受到研究人员重视。运用可逆逻辑电路对传统脉冲分配器进行可逆设计,并提供了物理实现方法。首先对传统的脉冲分配器中的触发器和计数器进行可逆设计,然后将传统脉冲分配器的中的计数器进行替换,最后将可逆计数器和译码...
上传时间: 2013-11-02
上传用户:zhangchu0807
资源简介:CD40系列CD45系列集成芯片DATASHEET数据手册170个芯片技术手册资料合集:4000 CMOS 3输入双或非门1反相器.pdf4001 CMOS 四2输入或非门.pdf4002 CMOS 双4输入或非门.pdf4006 CMOS 18级静态移位寄存器.pdf4007 CMOS 双互补对加反相器.pdf4008 CMOS 4位二进制并行...
上传时间: 2021-11-09
上传用户:kent
资源简介:常用4000系列标准数字电路的中文名称资料 型号 器件名称 厂牌 备注 CD4000 双3输入端或非门+单非门 TI CD4001 四2输入端或非门 HIT/NSC/TI/GOL CD4002 双4输入端或非门 NSC CD4006 18位串入/串出移位寄存器 NSC CD4007 双互补...
上传时间: 2022-05-05
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资源简介:阐述了一种基于反射式光电传感器的直流电机测速及控制系统K该系统可适用于无法采用旋转编码器和测速电机进行直流电机测速与控制的场合L 文中采用斯密特触发器、异或门、D 触发器以及可逆计数器设计了可用于脉冲
上传时间: 2013-05-17
上传用户:busterman
资源简介:设计四 拔河游戏机 1、 设计一个能进行拔河游戏的电路。 2、 电路使用15个(或9个)发光二极管,开机后只有中间一个发亮,此即拔河的中心点。 3、 游戏双方各持一个按钮,迅速地、不断地按动,产生脉冲,谁按得快,亮点就向谁的方向移动,每按一次,亮点移动...
上传时间: 2015-06-08
上传用户:LouieWu
资源简介:常用电源类通讯类ST单片机芯片集成库原理图库PCB库AD封装库器件库2D3D库+器件手册合集,已在项目中使用,可以作为你的设计参考。SV text has been written to file : 74系列芯片.csv74HC04 6通道单输入输出反相器74HC138 ...
上传时间: 2022-03-03
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资源简介:异步复位、同步置数的四位二进制计数器的VHDL源文件
上传时间: 2016-06-20
上传用户:woshiayin
资源简介:计数器是常用的时序逻辑电路器件,文中介绍了以四位同步二进制集成计数器74LS161和异步二-五-十模值计数器74LS290为主要芯片,设计实现了任意模值计数器电路,并用Multisim软件进行了仿真。仿真验证了设计的正确性和可靠性,设计与仿真结果表明,中规模集成计...
上传时间: 2014-12-23
上传用户:Vici
资源简介:可预置可逆4位计数器
上传时间: 2014-12-25
上传用户:fang2010
资源简介:四位二进制计数器与半加器
上传时间: 2013-12-24
上传用户:来茴
资源简介:可预置可逆4位计数器 利用AT89S51单片机的P1.0-P1.3接四个发光二极管L1-L4,用来指示当前计数的数据;用P1.4-P1.7作为预置数据的输入端,接四个拨动开关K1-K4,用P3.6/WR和P3.7/RD端口接两个轻触开关,用来作加计数和减计数开关
上传时间: 2014-01-15
上传用户:海陆空653
资源简介:计数器 同步异步预置数清零 verilog hdl 编写
上传时间: 2013-12-18
上传用户:凤临西北
资源简介:一个用VerilogHDL语言编写的模6的二进制计数器
上传时间: 2015-07-22
上传用户:sjyy1001
资源简介:同步计数器和异步计数器在设计时有哪些区别?试用 六进制计数器和一个十进制计数器构成一个六十进制同步计数器。
上传时间: 2013-12-14
上传用户:xiaoyunyun
资源简介:本文为采用VHDL编写的程序及报告。步骤如下:1设计三位二进制计数器程序 二:设计一驱动循环显示7位数字 2编写LED控制程序如下: 3设计采用原理图方式如下:
上传时间: 2015-11-18
上传用户:cjf0304
资源简介:DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.
上传时间: 2013-12-26
上传用户:希酱大魔王
资源简介:基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器
上传时间: 2014-01-17
上传用户:lhw888
资源简介:六十进制计数器.电子万年历是计数器的应用之一.年由月的十二进制计数器进位+1得到.月是日的三十进制计数器进位+1得到.日是小时的二十四进制计数器进位+1得到.小时是分的六十进制计数器进位+1得到.分是秒的六十进制计数器进位+1得到.本程序基于VHDL.其开发环境...
上传时间: 2014-11-29
上传用户:13215175592
资源简介:基于VHDL的4位带异步清零的二进制计数器。
上传时间: 2014-01-17
上传用户:日光微澜
资源简介:巴克码生成与测试电路。 当计数脉冲不断进入由Q3Q2Q1组成的三位二进制异步计数器时,3-8译码器的8个输出经反相器后顺序输出高电平。其中五路信号经“或非”后再和其中3路“或”,在Y端便可顺序产生11000100代码序列。
上传时间: 2016-04-18
上传用户:极客
资源简介:带使能、 异步复位端的十二进制计数器的 设计的一个例子
上传时间: 2016-06-20
上传用户:gmh1314
资源简介:带有异步复位和同步时钟的十进制加法计数器
上传时间: 2014-12-02
上传用户:黄华强