本论文主要研究分析了扩频码捕获的算法，在对传统捕获算法分析基础上，提出基于差分码和块处理的捕获算法，并在FPGA芯片上，应用高速硬件描述语言给予实现。 本论文首先详细地介绍时域串行捕获、匹配滤波捕获、FFT并行频域捕获等算法的原理，并应用MATLAB软件，对其检测概率、虚警概率、平均捕获时间、运算量和消耗硬件资源等性能指标进行仿真分析。在传统算法基础上，提出一种基于差分码和块处理的捕获算法，给出了原理和实现方案。对比分析此算法的检测概率、虚警概率、平均捕获时间、运算量和消耗硬件资源等性能指标，得出在不损失处理增益的前提下，既加快了捕获时间，又降低了资源消耗，实现了捕获时间和资源消耗的良好结合。最后在EP1S808956C6芯片上，应用ALTERA公司的FPGA开发工具QUARTUS 6.1，采用了国际标准的硬件描述语言—VHDL语言和框图设计，对此算法给予硬件实现。
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