虫虫首页
|
资源下载
|
资源专辑
|
精品软件
登录
|
注册
首 页
资源下载
资源专辑
技术阅读
电 路 图
教程书籍
在线计算器
代码搜索
资料搜索
代码搜索
热门搜索:
fpga
51单片机
protel99se
机器人
linux
单片机
dsp
arm
Proteus
matlab
您现在的位置是:
虫虫下载站
>
资源下载
>
技术资料
> 基于VHDL的时钟设计(de2开发平台)
基于VHDL的时钟设计(de2开发平台)
资源大小:
3482 K
上传时间:
2023-09-05
上传用户:
lostxc
资源积分:
2 下载积分
标 签:
vhdl
时钟设计
de2
资 源 简 介
基于VHDL的时钟设计(de2开发平台) 基于VHDL的时钟设计(de2开发平台)
免注册下载
普通下载
相 关 资 源
您 可 能 感 兴 趣 的
vhdl数字时钟设计 目的
VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效
vhdl经典源代码——时钟设计
功能更加完善的基于vhdl的数字时钟设计 有秒表
VHDL多功能时钟设计~~24小时制~带闹钟
基于VHDL的电子时钟设计
采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。
利用VHDL语言设计一个电子时钟
基于vhdl语言的数字时钟设计说明书
[VHDL经典设计26例]--在xilinx芯片上调试通过--[01--1位全加器][02--2选1多路选择器][03--8位硬件加法器][04--7段数码显示译码器][05--8位串入并出寄存器][
收藏
赞(62)
踩(0)
用户登录/注册
×
确认下载
×
免注册下载
×
扫码关注并回复消息
发送: “MPS新能源” 获取验证码,验证成功后下载文件。
提交
请输入正确的验证码
用户登录
×
用户注册
×