verilog 编写的pic16c5x时钟模块
资源简介:verilog 编写的pic16c5x时钟模块
上传时间: 2015-10-25
上传用户:xiaodu1124
资源简介:verilog编写的计算百分比模块
上传时间: 2013-12-17
上传用户:wang0123456789
资源简介:一个用verilog编写的数字时钟,最后在8段数码管上显示出来,对于初学verilog的有一定的帮助,是一个工程文件
上传时间: 2013-12-01
上传用户:363186
资源简介:verilog编写的流水线模块
上传时间: 2015-03-09
上传用户:杜莹12345
资源简介:verilog编写的alu模块
上传时间: 2015-03-09
上传用户:qb1993225
资源简介:verilog编写的状态机检测00100序列. 实现 input:...011000010010000... output:...000000000100100... 并且 用测试模块来验证状态是否正确工作
上传时间: 2015-07-14
上传用户:ggwz258
资源简介:用verilog语言编写的看门狗模块modulewdt
上传时间: 2013-12-23
上传用户:jjj0202
资源简介:verilog编写的时钟控制程序,在xilinx芯片上开发。具有案件防抖等考虑,
上传时间: 2016-09-19
上传用户:英雄
资源简介:用verilog编写的高速8路并行dds模块,用于与高速da(1ghz或以上)接口产生任意频率正弦波,模块已经经过工程验证,用于产品中。
上传时间: 2014-01-04
上传用户:ruan2570406
资源简介:用verilog编写的4位ALU,由算术运算模块、逻辑运算模块、选择模块组成
上传时间: 2014-01-04
上传用户:Amygdala
资源简介:由verilog编写的乘法器,通过两个文件的调用实现。由于子模块的调用使得程序简化了许多。
上传时间: 2014-08-29
上传用户:luopoguixiong
资源简介:C51编写的实时时钟程序,用1602液晶模块显示,使用DS1302时钟芯片
上传时间: 2013-11-28
上传用户:woshini123456
资源简介:使用verilog编写的同步FIFO,可通过设置程序中的DEPTH设置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中写入数据,\r\nFIFO_READ_CLOCK上升沿读取数据。本程序对FIFO上层操作简单实用。
上传时间: 2013-08-12
上传用户:ljt101007
资源简介:verilog 编写的I2c协议程序,用于cpld读写EEPROM
上传时间: 2013-08-31
上传用户:csgcd001
资源简介:用Java编写的小时钟
上传时间: 2014-08-05
上传用户:佳期如梦
资源简介:用编写的一个时钟程序
上传时间: 2015-02-06
上传用户:jyycc
资源简介:用verilog编写的多功能数字钟
上传时间: 2015-02-25
上传用户:王者A
资源简介:这是一个很好的verilog 编写的8位RISC CPU源码(可做为MCU),并且包括完整的C 语言的测试代码。
上传时间: 2014-01-05
上传用户:李梦晗
资源简介:verilog编写的32位浮点加法器
上传时间: 2015-03-09
上传用户:372825274
资源简介:verilog编写的全功能串口
上传时间: 2014-02-11
上传用户:Breathe0125
资源简介:加法器(使用verilog编写的),虽然简单,但是这也是学习verilog最基础的东西!希望大家一起学习!
上传时间: 2013-12-10
上传用户:410805624
资源简介:用verilog编写的网卡芯片rtl级。前仿后仿都通过了,可以在modelsim上运行察看
上传时间: 2015-03-31
上传用户:lxm
资源简介:采用verilog编写的串口通信程序,采用了状态机设计!程序简单,消耗资源少
上传时间: 2014-12-08
上传用户:yd19890720
资源简介:verilog编写的M序列发生器,希望能对大家带来帮助。
上传时间: 2014-01-11
上传用户:zhliu007
资源简介:verilog 实现的jtag ip模块 包括了测试程序
上传时间: 2014-12-08
上传用户:叶山豪
资源简介:CHDL语言编写的数字时钟程序 具有时间显示,整点报时,零点报时,和时间可调
上传时间: 2013-12-10
上传用户:lacsx
资源简介:用VHDL编写的数字时钟,可变宽度脉冲产生器
上传时间: 2014-12-02
上传用户:xaijhqx
资源简介:一个汇编编写的彩色时钟及其源代码,内含操作说明,对于汇编的初学者来说有一定帮助
上传时间: 2015-05-09
上传用户:wang0123456789
资源简介:一个非常简单的cpu设计的原代码,是用verilog编写的
上传时间: 2014-12-08
上传用户:siguazgb
资源简介:用verilog编写的pci——rtl级。
上传时间: 2015-06-06
上传用户:亚亚娟娟123