用VHDL结构描述设计一全减器,全减器可由两个半减器和一个或门组成。
资源简介:用VHDL结构描述设计一全减器,全减器可由两个半减器和一个或门组成。
上传时间: 2013-12-22
上传用户:思琦琦
资源简介:用VHDL编写的8位全加器,数字分频器等程序
上传时间: 2013-12-16
上传用户:ztj182002
资源简介:用VHDL语句描述4位等值比较器,4选1多路选择器,8位奇偶校验电路功能
上传时间: 2014-01-15
上传用户:FreeSky
资源简介:一种用VHDL语言描述的加减算法的源代码编程
上传时间: 2013-12-27
上传用户:heart520beat
资源简介:一位全减器的VHDL的设计报告,里面包含完整的程序
上传时间: 2015-07-23
上传用户:黄华强
资源简介:该程序用VHDL硬件描述语言编写而成,已调试通过,程序运行后可实现三分频,这样就用软件设计代替了硬件设计,方便,稳定,不需要硬件调试!
上传时间: 2013-12-24
上传用户:huyiming139
资源简介:用VHDL 语言描述频率计的设计,其开发均在FPGA中
上传时间: 2013-12-24
上传用户:change0329
资源简介:用VHDL语言描述十六路彩灯的设计其开发均在FPGA中
上传时间: 2014-01-10
上传用户:日光微澜
资源简介:用VHDL硬件描述语言,采用一种软件硬化的设计思路设计了控制器。将控制器划分成八个模块
上传时间: 2016-04-25
上传用户:jennyzai
资源简介:用1位半减器构成一位全减器,之后再构成8位全减器。有三个组件:h_suber,一位半减器,f_suber,一位全减器,f_suber8,8位全减器。
上传时间: 2016-06-30
上传用户:mpquest
资源简介:用VHDL硬件描述语言完成秒表的设计,分6个模块
上传时间: 2016-08-24
上传用户:大三三
资源简介:本文十一个用VHDL频率计设计的方案描述,该设计阐明了设计的思路,步骤以及设计的最终代码,设计方案十分详细,是您学习的必备辅助!
上传时间: 2016-11-25
上传用户:我干你啊
资源简介:一种用VHDL语言描述的浮点前规格化的源代码编程
上传时间: 2013-12-28
上传用户:lijianyu172
资源简介:一种用VHDL语言描述的浮点乘前规格化的源代码编程
上传时间: 2014-01-20
上传用户:jennyzai
资源简介:一种用VHDL语言描述的浮点除前规格化的源代码编程
上传时间: 2014-01-16
上传用户:cmc_68289287
资源简介:一种用VHDL语言描述的浮点平方根前规格化的源代码编程
上传时间: 2014-01-22
上传用户:hzy5825468
资源简介:此程序是用VHDL硬件描述语言编写的,实现四位全加器的功能
上传时间: 2017-01-07
上传用户:天诚24
资源简介:VHDL设计实体的基本结构 VHDL的语言要素 用VHDL实现电路设计的方法 VHDL设计流程
上传时间: 2014-01-06
上传用户:dongbaobao
资源简介:数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述,集成在一个模块中,提供VHDL源程序供大家学习和讨论。\r\n
上传时间: 2013-09-04
上传用户:a471778
资源简介:用VHDL硬件描述语言实现的对FPGA(Cyclone II)的配置的VHDL源代码。
上传时间: 2015-04-02
上传用户:nanxia
资源简介:程序用VHDL实现: 利用一秒定时测量频率 并且显示,范围0~
上传时间: 2015-04-06
上传用户:sxdtlqqjl
资源简介:数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述,集成在一个模块中,提供VHDL源程序供大家学习和讨论。
上传时间: 2014-08-31
上传用户:yan2267246
资源简介:用VHDL硬件描述语言开发的miniUART接口IP Core,用户可以将其嵌入到自己的FPGA模块中。
上传时间: 2015-07-22
上传用户:稀世之宝039
资源简介:用VHDL硬件描述语言编写的FIR数字滤波器
上传时间: 2014-01-22
上传用户:cuibaigao
资源简介:SDI接口的源程序,包括扰码编码,并串转换,用VHDL硬件描述语言编写
上传时间: 2014-08-24
上传用户:gtzj
资源简介:用VHDL硬件语言设计的16位cpu,上传的压缩包既包含源代码又包含详细的文档说明。
上传时间: 2015-10-27
上传用户:refent
资源简介:用VHDL 语言描述度7段LED数码显示管,其开发均在FPGA中
上传时间: 2015-11-11
上传用户:lanhuaying
资源简介:用VHDL 语言描述度三线八线译码器,其开发均在FPGA中
上传时间: 2013-12-20
上传用户:love1314
资源简介:用VHDL 语言描述度八层电梯,其开发均在FPGA中
上传时间: 2013-12-17
上传用户:ljt101007
资源简介:基本数学运算库 包括各种用VHDL语言描述的基本数学运算单元,瑞典联邦技术研究院(ETH)提供
上传时间: 2013-12-24
上传用户:1583060504