JTAG CPLD实现源代码,比用简单并口调试器快5倍以上。 以前总觉得简单的并口jtag板速度太慢,特别是调试bootloader的时候,简直难以忍受。最近没什么事情,于是补习了几天vhdl,用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15,晶振20兆,tck频率5兆。用sjf2410作测试,以前写50k的文件用时5分钟,现在则是50秒左右。tck的频率还可以加倍,但是不太稳定,而且速度的瓶颈已经不在tck这里,而在通讯上面了。
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上传时间: 2013-09-04
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上传时间: 2015-05-16
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上传时间: 2013-05-27
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上传时间: 2013-07-18
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上传时间: 2013-08-07
上传用户:klin3139
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上传时间: 2013-08-14
上传用户:xingisme
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上传时间: 2013-08-16
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上传时间: 2013-08-20
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上传时间: 2013-08-22
上传用户:cherrytree6
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上传时间: 2013-08-28
上传用户:chenhr
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上传时间: 2013-08-30
上传用户:wyc199288
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上传用户:786334970
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上传时间: 2013-12-25
上传用户:kelimu
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上传时间: 2015-01-16
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上传时间: 2015-01-20
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上传时间: 2015-01-26
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上传时间: 2013-12-01
上传用户:kelimu
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上传时间: 2015-01-27
上传用户:skhlm
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上传时间: 2015-01-28
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上传时间: 2014-01-27
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上传时间: 2015-02-03
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上传时间: 2014-12-21
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上传时间: 2015-02-03
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