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用VHDL设计一个4位二进制并行半加器

  • 资源大小:2 K
  • 上传时间: 2014-11-24
  • 上传用户:rickie936
  • 资源积分:2 下载积分
  • 标      签: VHDL 二进制 并行 半加器

资 源 简 介

用VHDL设计一个4位二进制并行半加器,要求将被加数、加数和加法运算和用动态扫描的方式共阴数码管一同时显示出

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