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Verlog HDL 写得一款32路方波发生器

  • 资源大小:59 K
  • 上传时间: 2016-12-07
  • 上传用户:Mrsliu
  • 资源积分:2 下载积分
  • 标      签: Verlog HDL 方波发生器

资 源 简 介

Verlog HDL 写得一款32路方波发生器,例子是4路可以自己加,相位可调,频率可调,占空比可调。具体参见readme.doc.此处只提供了源码包含顶层模块sgs32.v 子模块dds.v和pll设置模块altp.v及波形驱动文件

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