基于vriloge的数字钟具有调时、分、秒和定时报警功能

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  上传时间： 2013-12-22

  上传用户：AbuGe

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  上传时间： 2017-06-01

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  上传时间： 2013-12-04

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  上传时间： 2013-12-20

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  上传时间： 2013-12-27

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  标签： 7128 EPM 数字

  上传时间： 2016-11-10

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  上传时间： 2013-12-17

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  上传时间： 2013-12-25

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  标签： IBM 汇编语言 数字 程序

  上传时间： 2013-12-11

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  标签： vhdl 语言 数字

  上传时间： 2017-07-26

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  资源简介：基于FPGA的多功能数字钟Verilog设计2007-06-17 21:06基本功能： 1．具有时、分、秒计数显示功能（6位数码管构成），以24小时循环为计时基准。 2. 具有调节小时、分钟的功能。 3．具有整点报时功能，整点报时的同时数码管显示闪烁提示。

  标签： Verilog FPGA 2007 06

  上传时间： 2016-03-10

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  资源简介：本设计要实现一个具有预置数的数字钟的设计,具体要求如下: 1. 正确显示年、月、日 2. 正确显示时、分、秒 3. 具有校时,整点报时和秒表功能 4. 进行系统模拟仿真和下载编程实验,验证系统的正确性

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  上传时间： 2013-12-18

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  上传时间： 2013-12-22

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  资源简介：本设计要实现一个具有预置数的数字钟的设计,具体要求如下:\r\n1. 正确显示年、月、日 \r\n2. 正确显示时、分、秒 \r\n3. 具有校时,整点报时和秒表功能 \r\n4. 进行系统模拟仿真和下载编程实验,验证系统的正确性 \r\n

  标签： CPLD 设计实现 数字 预置数

  上传时间： 2013-09-01

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