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> 模拟电路设计软件仿真语言和数字语言VERILOG想对应主要用于模拟系统建模
模拟电路设计软件仿真语言和数字语言VERILOG想对应主要用于模拟系统建模
资源大小:
5582 K
上传时间:
2014-01-05
上传用户:
singwolf
资源积分:
2 下载积分
标 签:
VERILOG
语言
模拟电路设计
数字
资 源 简 介
模拟电路设计软件仿真语言和数字语言VERILOG想对应主要用于模拟系统建模
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