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This Verilog HDL description implements a UART.

  • 资源大小:4 K
  • 上传时间: 2013-12-17
  • 上传用户:Sundaymorn
  • 资源积分:2 下载积分
  • 标      签: description implements Verilog This

资 源 简 介

This Verilog HDL description implements a UART.

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