虫虫首页| 资源下载| 资源专辑| 精品软件
登录| 注册

您现在的位置是:虫虫下载站 > 资源下载 > 应用设计 > verilog设计加法器

verilog设计加法器

  • 资源大小:54 K
  • 上传时间: 2017-02-26
  • 上传用户:zhangqi
  • 资源积分:2 下载积分
  • 标      签: verilog 加法器

资 源 简 介

用verilog设计加法器,经modelsim仿真测试没问题。有问题请反馈。

相 关 资 源