Quartus分频器设计试验

相 关 资 源

• Quartus分频器设计试验免费下载

  资源简介：熟悉分频电路的逻辑功能，并用硬件描述语言实现其设计。并利用已经实现的 VHDL 模块文件，采用原理图方法，实现 0-F 计数自动循环显示，频率 10Hz。 此文件中含有试验分析报告和详细的VHDL模块文件及原理图。

  标签： Quartus 分频器

  上传时间： 2016-11-27

  上传用户：我是李明澄

• 数控分频器设计:对于一个加法计数器免费下载

  资源简介：数控分频器设计:对于一个加法计数器，装载不同的计数初始值时，会有不同频率的溢出输出信号。计数器溢出时，输出‘1’电平，同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号；否则输出‘0’电平。

  标签： 数控 分频器 加法 计数器

  上传时间： 2015-07-16

  上传用户：wxhwjf

• 《分频器设计》绝对好用的EDA实验程序！已经通过测试。VHDL语言编写免费下载

  资源简介：《分频器设计》绝对好用的EDA实验程序！已经通过测试。VHDL语言编写

  标签： VHDL EDA 分频器 实验

  上传时间： 2013-11-29

  上传用户：star_in_rain

• 基于FPGA的分频器设计,已经通过了仿真(VHDL语言编写)免费下载

  资源简介：基于FPGA的分频器设计,已经通过了仿真(VHDL语言编写)

  标签： FPGA VHDL 分频器 仿真

  上传时间： 2013-12-14

  上传用户：haoxiyizhong

• 基于vhdl的数控分频器设计的源代码及仿真免费下载

  资源简介：基于vhdl的数控分频器设计的源代码及仿真

  标签： vhdl 数控 分频器 仿真

  上传时间： 2016-02-11

  上传用户：410805624

• 基于VHDL的分频器设计免费下载

  资源简介：基于VHDL的分频器设计，这是源码希望对大家有用。

  标签： VHDL 分频器

  上传时间： 2014-01-25

  上传用户：watch100

• 好的分频器设计程序免费下载

  资源简介：好的分频器设计程序，有三个，二分频，八分频随便改，比较实用

  标签： 分频器 设计程序

  上传时间： 2016-07-15

  上传用户：songyue1991

• 利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计免费下载

  资源简介：利用数控分频器设计硬件电子琴.硬件电子琴电路模块设计

  标签： 硬件 电子琴 数控 分频器

  上传时间： 2013-11-28

  上传用户：Shaikh

• 利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23）免费下载

  资源简介：利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23），用HEX3~HEX2显示分钟（0~59），用HEX1~HEX0显示秒钟（0~59）。

  标签： HEX 计数器 模 1Hz

  上传时间： 2014-12-20

  上传用户：dbs012280

• 基于vhdl的分频器设计免费下载

  资源简介：基于vhdl的分频器设计，分频器在数字系统设计中应用频繁

  标签： vhdl 分频器

  上传时间： 2017-03-31

  上传用户：脚趾头

• 数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成 果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性免费下载

  资源简介：数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成 果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性强。他可利用 并行预置数的加法计数器和减法计数器实现...

  标签： VHDL 数控 分频器 修改

  上传时间： 2014-11-29

  上传用户：1051290259

• 分别用分频比交错法及累加器分频法完成非整数分频器设计。免费下载

  资源简介：分别用分频比交错法及累加器分频法完成非整数分频器设计。

  标签： 分频 分 累加器 整数

  上传时间： 2014-01-01

  上传用户：shus521

• VHDl分频器设计免费下载

  资源简介：分频器的设计，十分简单好用。入门用户的好选择，不容错过。

  标签： EDA VHDL 分频

  上传时间： 2015-12-15

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• 用verilog实现fpga的通用分频器的实现免费下载

  资源简介：用verilog实现了奇数和偶数不同的分频器设计

  标签： verilog fpga 分频器

  上传时间： 2016-07-11

  上传用户：jhjjh

• 基于Quartus II的数控分频器的项目设计免费下载

  资源简介：基于Quartus II的数控分频器的项目设计，实现对时钟信号的任意进制分频，包含了项目文件和VHDL源代码

  标签： Quartus 数控 分频器 项目设计

  上传时间： 2017-07-18

  上传用户：yangbo69

• 本文主要介绍了50％占空比三分频器的三种设计方法免费下载

  资源简介：本文主要介绍了50％占空比三分频器的三种设计方法，并给出了图形设计、VHDL设计、编译结果和仿真结果。设计中采用EPM7064AETC44-7 CPLD，在QuartusⅡ4.2软件平台上进行。

  标签： 三分频 设计方法

  上传时间： 2014-01-25

  上传用户：凌云御清风

• 分频器 FPGＡ程序设计　二分频免费下载

  资源简介：分频器 FPGＡ程序设计　二分频　对硬件设计有很大用处\r\n

  标签： FPG 分频器 二分频 程序设计

  上传时间： 2013-08-31

  上传用户：lhc9102

• 基于CPLD-FPGA的半整数分频器的设计免费下载

  资源简介：基于CPLD-FPGA的半整数分频器的设计，用于设计EDA

  标签： CPLD-FPGA 整数 分频器

  上传时间： 2013-09-03

  上传用户：pioneer_lvbo

• 用VerilogHDL实现基于FPGA的通用分频器的设计免费下载

  资源简介：用VerilogHDL实现基于FPGA的通用分频器的设计

  标签： VerilogHDL FPGA 分频器

  上传时间： 2013-10-28

  上传用户：xiaoxiang

• 用VerilogHDL实现基于FPGA的通用分频器的设计免费下载

  资源简介：用VerilogHDL实现基于FPGA的通用分频器的设计

  标签： VerilogHDL FPGA 分频器

  上传时间： 2015-01-02

  上传用户：oooool

• 基于CPLD-FPGA的半整数分频器的设计免费下载

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  标签： CPLD-FPGA 整数 分频器

  上传时间： 2015-04-09

  上传用户：凌云御清风

• 带分频器的bcd计数电路设计免费下载

  资源简介：带分频器的bcd计数电路设计，verilog源码

  标签： bcd 分频器 计数电路

  上传时间： 2014-01-14

  上传用户：s363994250

• 第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计免费下载

  资源简介：第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计

  标签： 7.1 7.2 7.3 FSK

  上传时间： 2015-06-23

  上传用户：tianyi223

• 本文件介绍的是用VerilogHDL语言设计分频器和32位计数器.免费下载

  资源简介：本文件介绍的是用VerilogHDL语言设计分频器和32位计数器.

  标签： VerilogHDL 语言 分频器 计数器

  上传时间： 2013-12-15

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• 分频器 FPGＡ程序设计　二分频　对硬件设计有很大用处免费下载

  资源简介：分频器 FPGＡ程序设计　二分频　对硬件设计有很大用处

  标签： FPG 分频器 二分频 程序设计

  上传时间： 2014-01-25

  上传用户：z754970244

• 本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程免费下载

  资源简介：本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50％的奇数分频。利用VHDL语言编程，并用QUARTERS||4.0进行仿真，用 FPGA 芯片实现。 关键词：半整数，可控分频器，VHDL, FPGA

  标签： VHDL 分频 整数 系数

  上传时间： 2015-11-27

  上传用户：tyler

• EDA常用计数函数VHDL程序设计,基于VHDL的交通灯设计实例&分频器免费下载

  资源简介：EDA常用计数函数VHDL程序设计,基于VHDL的交通灯设计实例&分频器

  标签： VHDL EDA 函数 交通灯

  上传时间： 2013-12-23

  上传用户：yyq123456789

• 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL免费下载

  资源简介：分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先...

  标签： altera FPGA PLL 分频器

  上传时间： 2016-06-14

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  资源简介：一个可实现多倍（次）分频器VHDL源代码设计

  标签： VHDL 分频器 源代码

  上传时间： 2014-01-27

  上传用户：2467478207

• 一个基于CPLD/FPGA的半整数分频器的设计的文档资料免费下载

  资源简介：一个基于CPLD/FPGA的半整数分频器的设计的文档资料

  标签： CPLD FPGA 整数 分频器

  上传时间： 2016-07-13

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